中茵微电子(南京)有限公司薛战获国家专利权
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龙图腾网获悉中茵微电子(南京)有限公司申请的专利一种基于LPDDR5/5X PHY IO电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119883989B 。
龙图腾网通过国家知识产权局官网在2025-07-15发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510364328.X，技术领域涉及：G06F13/40；该发明授权一种基于LPDDR5/5X PHY IO电路是由薛战设计研发完成，并于2025-03-26向国家知识产权局提交的专利申请。
本一种基于LPDDR5/5X PHY IO电路在说明书摘要公布了：本发明的目的是提供一种基于LPDDR55XPHYIO电路，该电路包括：接收器电路；所述接收器电路包括：第一粗调电路；所述第一粗调电路的输入端与模拟放大电路连接，输出端与第一D‑触发器连接；所述第一粗调电路位于时钟路径。本发明通过改善IO架构，巧妙地将CDL模块由原来的数据路径调到时钟路径上，这样能够达到相同延迟的调节结果。但是能够很好地改善IOTX端输出数据与RX端输入数据的抖动。同时改善数据周期，也能一定程度的改善数据积累抖动。通过降低了数据路径上的延迟单元，尤其对高速数据信号，对ISI的影响能够起到很好的改善，从而提高信号质量。
本发明授权一种基于LPDDR5/5X PHY IO电路在权利要求书中公布了：1.一种基于LPDDR55XPHYIO电路，其特征在于，包括：接收器电路； 所述接收器电路包括：第一粗调电路； 所述第一粗调电路的输入端与模拟放大电路连接，输出端与第一D-触发器连接； 所述第一粗调电路位于时钟路径； 所述第一粗调电路具体包括：第一比较器、第二比较器、第一非门、第二非门、第一D寄存器、第二D寄存器、加法器和DA转换器； 所述第一比较器的输出端与所述第一非门的输入端连接； 所述第一非门的输出端与所述第一D寄存器的D端连接； 所述第一D寄存器的CK端与时钟信号连接，Q端与所述加法器连接； 所述第二比较器的输出端与所述第二非门的输入端连接； 所述第二非门的输出端与所述第二D寄存器的D端连接； 所述第二D寄存器的CK端与时钟信号连接，Q端与所述加法器连接； 所述加法器的输出端与所述DA转换器的输入端连接。
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