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龙图腾网获悉北京炬玄智能科技有限公司申请的专利一种跨时钟域通信电路及数据读写方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120045018B 。

龙图腾网通过国家知识产权局官网在2025-07-18发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510527696.1，技术领域涉及：G06F1/12；该发明授权一种跨时钟域通信电路及数据读写方法是由王晓晖;李红;刘洋设计研发完成，并于2025-04-25向国家知识产权局提交的专利申请。

本一种跨时钟域通信电路及数据读写方法在说明书摘要公布了：本发明公开了一种跨时钟域通信电路及数据读写方法，涉及跨时钟域通信领域，该电路中电平展开单元在第一时钟下根据原始写使能信号及通信结束标志信号输出电平信号，通信结束标志信号在此次写通信指令已结束且N个字节的目标数据已写入缓存时处于有效状态，写标志信号生成单元用于在第一时钟下输出写标志信号，写标志信号处于无效状态时，当电平信号及通信结束标志信号均处于有效状态时被置位而处于有效状态并保持；同步单元将写标志信号在第二时钟下同步以得到同步信号，以便写使能信号生成单元产生第二时钟下的写使能信号。该方案无需额外启动高频时钟，利于降低功耗；利于合理确定多字节目标数据在第二时钟下写入时刻且对应的写入时刻相同。

本发明授权一种跨时钟域通信电路及数据读写方法在权利要求书中公布了：1.一种跨时钟域通信电路，其特征在于，包括依次连接的电平展开单元、写标志信号生成单元、同步单元及写使能信号生成单元； 所述电平展开单元用于在第一时钟下，根据接收到的原始写使能信号及通信结束标志信号进行电平展开以输出电平信号；所述原始写使能信号在所述第一时钟下接收到写通信指令时处于有效状态，所述通信结束标志信号在所述写通信指令已结束且N个字节的目标数据已写入缓存时处于有效状态，N为不小于1的整数； 所述写标志信号生成单元用于在所述第一时钟下根据接收到的所述电平信号及所述通信结束标志信号输出写标志信号；所述写标志信号用于在处于无效状态的情况下，当所述电平信号及所述通信结束标志信号均处于有效状态时被置位而处于有效状态并保持； 所述同步单元用于将所述写标志信号在第二时钟下进行同步以得到同步信号，以便所述写使能信号生成单元根据所述同步信号进行边沿提取以产生所述第二时钟下的写使能信号；其中，所述第一时钟与所述第二时钟为异步时钟； 所述电平展开单元包括触发逻辑电路及第一触发器； 所述触发逻辑电路的第一输入端用于接收所述原始写使能信号，第二输入端用于接收所述通信结束标志信号，第三输入端与所述第一触发器的数据输出端连接且连接的公共端与所述写标志信号生成单元连接，输出端与所述第一触发器的数据输入端连接，用于在所述原始写使能信号由无效状态转为有效状态时输出第一电平，且保持输出所述第一电平直到所述通信结束标志信号由有效状态转为无效状态时输出第二电平； 所述第一触发器的时钟信号输入端与所述第一时钟连接，用于在接收到所述第一电平时输出处于有效状态的电平信号，在接收到所述第二电平时输出处于无效状态的电平信号； 所述触发逻辑电路包括第六非门、第七非门、第五与门及第二或门；所述第六非门的输入端用于与所述第二或门的第一输入端连接且连接的公共端作为所述触发逻辑电路的第一输入端，输出端与所述第五与门的第一输入端连接；所述第七非门的输入端作为所述触发逻辑电路的第二输入端，输出端与所述第五与门的第二输入端连接；所述第五与门的第三输入端作为所述触发逻辑电路的第三输入端，输出端与所述第二或门的第二输入端连接；第二或门的输出端作为所述触发逻辑电路的输出端。

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