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龙图腾网获悉友达光电股份有限公司申请的专利像素阵列基板获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116699913B 。

龙图腾网通过国家知识产权局官网在2025-07-25发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310638069.6，技术领域涉及：G02F1/1362；该发明授权像素阵列基板是由黄玄骅;魏霖杰;王浚泯设计研发完成，并于2023-06-01向国家知识产权局提交的专利申请。

本像素阵列基板在说明书摘要公布了：本发明公开一种像素阵列基板，包括多条数据线、多条扫描线及多个像素结构。多条扫描线包括依序排列的第m条扫描线及第m+1条扫描线，其中m为正整数。多个像素结构包括第一像素结构至第二十四像素结构。第七像素结构的晶体管的控制端及第八像素结构的晶体管的控制端分别电连接至第m+1条扫描线及第m条扫描线。第十三像素结构的晶体管的控制端及第十四像素结构的晶体管的控制端分别电连接至第m+1条扫描线及第m条扫描线。

本发明授权像素阵列基板在权利要求书中公布了：1.一种像素阵列基板，包括： 多条数据线，在第一方向上排列； 多条扫描线，在第二方向上排列，其中该第一方向与该第二方向交错；以及 多个像素结构，其中每一像素结构包括晶体管及像素电极，该晶体管具有第一端、第二端及控制端，该晶体管的该第一端电连接至该些数据线的一者，该晶体管的该控制端电连接至该些扫描线的一者，且该晶体管的该第二端电连接至该像素电极； 该些数据线包括在该第一方向上依序排列的第n条数据线、第n+1条数据线、第n+2条数据线、第n+3条数据线、第n+4条数据线、第n+5条数据线、第n+6条数据线、第n+7条数据线、第n+8条数据线、第n+9条数据线、第n+10条数据线、第n+11条数据线及第n+12条数据线，其中n为正整数，该第n条数据线、该第n+2条数据线、该第n+4条数据线、该第n+6条数据线、该第n+8条数据线、该第n+10条数据线及该第n+12条数据线具有第一极性，该第n+1条数据线、该第n+3条数据线、该第n+5条数据线、该第n+7条数据线、该第n+9条数据线及该第n+11条数据线具有第二极性，且该第一极性与该第二极性相反； 该些扫描线包括在该第二方向上依序排列的第m条扫描线及第m+1条扫描线，其中m为正整数； 该些像素结构包括第一像素结构、第二像素结构、第三像素结构、第四像素结构、第五像素结构、第六像素结构、第七像素结构、第八像素结构、第九像素结构、第十像素结构、第十一像素结构、第十二像素结构、第十三像素结构、第十四像素结构、第十五像素结构、第十六像素结构、第十七像素结构、第十八像素结构、第十九像素结构、第二十像素结构、第二十一像素结构、第二十二像素结构、第二十三像素结构及第二十四像素结构，其中该第一像素结构的该像素电极、该第二像素结构的该像素电极、该第三像素结构的该像素电极、该第四像素结构的该像素电极、该第五像素结构的该像素电极、该第六像素结构的该像素电极、该第七像素结构的该像素电极、该第八像素结构的该像素电极、该第九像素结构的该像素电极、该第十像素结构的该像素电极、该第十一像素结构的该像素电极、该第十二像素结构的该像素电极、该第十三像素结构的该像素电极、该第十四像素结构的该像素电极、该第十五像素结构的该像素电极、该第十六像素结构的该像素电极、该第十七像素结构的该像素电极、该第十八像素结构的该像素电极、该第十九像素结构的该像素电极、该第二十像素结构的该像素电极、该第二十一像素结构的该像素电极、该第二十二像素结构的该像素电极、该第二十三像素结构的该像素电极及该第二十四像素结构的该像素电极在该第一方向上依序排列； 在该像素阵列基板的俯视图中，该第一像素结构、该第二像素结构、该第三像素结构、该第四像素结构、该第五像素结构、该第六像素结构、该第七像素结构、该第八像素结构、该第九像素结构、该第十像素结构、该第十一像素结构、该第十二像素结构、该第十三像素结构、该第十四像素结构、该第十五像素结构、该第十六像素结构、该第十七像素结构、该第十八像素结构、该第十九像素结构、该第二十像素结构、该第二十一像素结构、该第二十二像素结构、该第二十三像素结构及该第二十四像素结构位于该第m条扫描线及该第m+1条扫描线之间； 在该像素阵列基板的俯视图中，该第一像素结构及该第二像素结构位于该第n条数据线及该第n+1条数据线之间，该第三像素结构及该第四像素结构位于该第n+1条数据线及该第n+2条数据线之间，该第五像素结构及该第六像素结构位于该第n+2条数据线及该第n+3条数据线之间，该第七像素结构及该第八像素结构位于该第n+3条数据线及该第n+4条数据线之间，该第九像素结构及该第十像素结构位于该第n+4条数据线及该第n+5条数据线之间，该第十一像素结构及该第十二像素结构位于该第n+5条数据线及该第n+6条数据线之间，该第十三像素结构及该第十四像素结构位于该第n+6条数据线及该第n+7条数据线之间，该第十五像素结构及该第十六像素结构位于该第n+7条数据线及该第n+8条数据线之间，该第十七像素结构及该第十八像素结构位于该第n+8条数据线及该第n+9条数据线之间，该第十九像素结构及该第二十像素结构位于该第n+9条数据线及该第n+10条数据线之间，该第二十一像素结构及该第二十二像素结构位于该第n+10条数据线及该第n+11条数据线之间，且该第二十三像素结构及该第二十四像素结构位于该第n+11条数据线及该第n+12条数据线之间； 该第一像素结构的该晶体管的该控制端及该第二像素结构的该晶体管的该控制端分别电连接至该第m条扫描线及该第m+1条扫描线，且该第一像素结构的该晶体管的该第一端及该第二像素结构的该晶体管的该第一端电连接至该第n+1条数据线； 该第三像素结构的该晶体管的该控制端及该第四像素结构的该晶体管的该控制端分别电连接至该第m条扫描线及该第m+1条扫描线，且该第三像素结构的该晶体管的该第一端及该第四像素结构的该晶体管的该第一端电连接至该第n+2条数据线； 该第五像素结构的该晶体管的该控制端及该第六像素结构的该晶体管的该控制端分别电连接至该第m+1条扫描线及该第m条扫描线，且该第五像素结构的该晶体管的该第一端及该第六像素结构的该晶体管的该第一端电连接至该第n+3条数据线； 该第七像素结构的该晶体管的该控制端及该第八像素结构的该晶体管的该控制端分别电连接至该第m+1条扫描线及该第m条扫描线，且该第七像素结构的该晶体管的该第一端及该第八像素结构的该晶体管的该第一端电连接至该第n+4条数据线； 该第九像素结构的该晶体管的该控制端及该第十像素结构的该晶体管的该控制端分别电连接至该第m条扫描线及该第m+1条扫描线，且该第九像素结构的该晶体管的该第一端及该第十像素结构的该晶体管的该第一端电连接至该第n+5条数据线； 该第十一像素结构的该晶体管的该控制端及该第十二像素结构的该晶体管的该控制端分别电连接至该第m+1条扫描线及该第m条扫描线，且该第十一像素结构的该晶体管的该第一端及该第十二像素结构的该晶体管的该第一端电连接至该第n+6条数据线； 该第十三像素结构的该晶体管的该控制端及该第十四像素结构的该晶体管的该控制端分别电连接至该第m+1条扫描线及该第m条扫描线，且该第十三像素结构的该晶体管的该第一端及该第十四像素结构的该晶体管的该第一端电连接至该第n+7条数据线； 该第十五像素结构的该晶体管的该控制端及该第十六像素结构的该晶体管的该控制端分别电连接至该第m条扫描线及该第m+1条扫描线，且该第十五像素结构的该晶体管的该第一端及该第十六像素结构的该晶体管的该第一端电连接至该第n+8条数据线； 该第十七像素结构的该晶体管的该控制端及该第十八像素结构的该晶体管的该控制端分别电连接至该第m+1条扫描线及该第m条扫描线，且该第十七像素结构的该晶体管的该第一端及该第十八像素结构的该晶体管的该第一端电连接至该第n+9条数据线； 该第十九像素结构的该晶体管的该控制端及该第二十像素结构的该晶体管的该控制端分别电连接至该第m条扫描线及该第m+1条扫描线，且该第十九像素结构的该晶体管的该第一端及该第二十像素结构的该晶体管的该第一端电连接至该第n+10条数据线； 该第二十一像素结构的该晶体管的该控制端及该第二十二像素结构的该晶体管的该控制端分别电连接至该第m条扫描线及该第m+1条扫描线，且该第二十一像素结构的该晶体管的该第一端及该第二十二像素结构的该晶体管的该第一端电连接至该第n+11条数据线； 该第二十三像素结构的该晶体管的该控制端及该第二十四像素结构的该晶体管的该控制端分别电连接至该第m+1条扫描线及该第m条扫描线，且该第二十三像素结构的该晶体管的该第一端及该第二十四像素结构的该晶体管的该第一端电连接至该第n+12条数据线。

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