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龙图腾网获悉南湖实验室申请的专利一种基于SoC FPGA的SRIO传输系统及传输方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119988272B 。

龙图腾网通过国家知识产权局官网在2025-07-29发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510430404.2，技术领域涉及：G06F13/36；该发明授权一种基于SoC FPGA的SRIO传输系统及传输方法是由冯广义;张佳威;齐亮;吴磊;李想;张雯设计研发完成，并于2025-04-08向国家知识产权局提交的专利申请。

本一种基于SoC FPGA的SRIO传输系统及传输方法在说明书摘要公布了：本发明公开了一种基于SoCFPGA的SRIO传输系统及传输方法，属于数据传输技术领域，考虑了多种类型数据采集传输，采用AXI‑FULL总线这种带有内存地址访问的方式进行数据交互，并进行随机数据存取操作，从而在需要频繁读写不同地址的场景中提高效率；使用PS加PL架构芯片实现SRIO传输系统，利用PS加PL架构芯片的FPGA在SRIO传输系统中做出包含大数据接收模块、大数据发送模块、数据类型采集模块等模块的PL与PL数据交互单元，包含GPIO控制模块、寄存器参数配置模块等模块的数据管理和控制单元，以及SRIO单元，配合优化的数据处理流程，实现了一个多种数据交互且高性能，高可靠性的SRIO系统，尤其在处理SRIO等高速传输时，系统的数据传输效率可得到显著提升。

本发明授权一种基于SoC FPGA的SRIO传输系统及传输方法在权利要求书中公布了：1.一种基于SoCFPGA的SRIO传输系统，包括包含PS加PL架构芯片的本地传输单元（1），所述的PS加PL架构芯片包括PS单元（2）和PL单元（3），其特征在于，所述的PL单元（3）包括采用FPGA实现且依次连接的SRIO单元（4）、PL与PS数据交互单元（5）、数据管理和控制单元（6）； 所述的PL与PS数据交互单元（5）包括数据采集模块（51）、大数据发送模块（52）、大数据接收模块（53），且PL与PS数据交互单元（5）的各模块均具有AXI4-Full总线接口； 所述的PS单元（2）包括CPU处理模块（21），所述的CPU处理模块（21）连接于所述的数据管理和控制单元（6）和DDR内存模块（7）； 所述的PL与PS数据交互单元（5）通过所述的AXI4-Full总线访问DDR内存模块（7）； 所述的数据管理和控制单元（6）用于根据CPU处理模块（21）的指令配置和控制PL与PS数据交互单元（5）的各模块； 大数据发送模块（52）和大数据接收模块（53）分别对应于DDR内存模块（7）的部分内存地址存储空间，且依控制而启动或关闭； 大数据发送模块（52）对应的内存地址存储空间被划分为多个存储区域，每个存储区域对应一个数据类型，数据采集模块（51）用于根据配置和控制采集相应类型的数据并存储至相应的存储区域； 大数据发送模块（52）用于根据配置和控制从相应的内存地址存储空间提取采集数据进行缓存以及跨时钟域处理； 大数据接收模块（53）用于接收DSP发送的重载数据，并存储至相应的内存地址存储空间； 所述的数据管理和控制单元（6）包括中断处理模块（62）、GPIO控制模块（63）和寄存器参数配置模块（61）； 所述的GPIO控制模块（63）用于根据CPU处理模块（21）的指令启动或关闭相应模块； 寄存器参数配置模块（61）用于根据CPU处理模块（21）的指令配置各模块。

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