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龙图腾网获悉深圳市紫光同创电子有限公司申请的专利可编程逻辑器件中节点单元的布局方法、装置及相关设备获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN113919267B 。

龙图腾网通过国家知识产权局官网在2025-07-29发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202111123320.2，技术领域涉及：G06F30/347；该发明授权可编程逻辑器件中节点单元的布局方法、装置及相关设备是由陈海博;姜振宇;王长龙;夏炜设计研发完成，并于2021-09-24向国家知识产权局提交的专利申请。

本可编程逻辑器件中节点单元的布局方法、装置及相关设备在说明书摘要公布了：本发明公开了一种可编程逻辑器件中节点单元的布局方法，应用于FPGA芯片设计领域，用于提升FPGA芯片设计过程中全局布局的效率。本发明提供的方法包括：获取所有从输入单元到输出单元的时序路径，以及每条时序路径的预设最大延时阈值；设定每条时序路径中相邻节点单元的路径为子时序路径，并计算出预设子时序路径最大延时；至少调整一个所述节点单元的位置，且被调整的节点单元的子时序路径的实际子时序路径延时小于所述预设子时序路径最大延时；计算时序损失值并判断所述时序损失值是否小于预设时序损失值，若否，则循环所述至少调整一个所述节点单元的位置至所述判断所述时序损失值是否小于预设时序损失值之间的步骤，若是，则完成所述FPGA芯片的全局布局。

本发明授权可编程逻辑器件中节点单元的布局方法、装置及相关设备在权利要求书中公布了：1.一种可编程逻辑器件中节点单元的布局方法，其特征在于，包括： 获取所有从输入单元到输出单元的时序路径，以及每条时序路径的预设最大延时阈值； 设定每条时序路径中相邻节点单元的路径为子时序路径，并根据所述预设最大延时阈值和所述子时序路径的数量计算出预设子时序路径最大延时，所述节点单元包括所述输入单元和所述输出单元； 至少调整一个所述节点单元的位置，使得被调整的节点单元的子时序路径的实际子时序路径延时小于所述预设子时序路径最大延时； 根据所述预设子时序路径最大延时、所述实际子时序路径延时和预设的损失函数计算时序损失值； 判断所述时序损失值是否小于预设时序损失值，若否，则循环所述至少调整一个所述节点单元的位置至所述判断所述时序损失值是否小于预设时序损失值之间的步骤，直到所述时序损失值小于预设时序损失值时完成布局； 其中，所述根据所述预设最大延时阈值和所述子时序路径的数量计算出预设子时序路径最大延时的步骤包括：通过以下公式计算所述预设子时序路径最大延时：；其中，表示所述预设最大延时阈值，表示所述子时序路径的数量，表示计算出的所述预设子时序路径最大延时； 其中，计算所述时序损失值的步骤包括：通过以下预设的损失函数计算所述时序损失值：；其中，表示实际子时序路径延时，表示预设子时序路径最大延时，表示预设常量值，i表示子时序路径的序号，表示计算出的时序损失值。

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