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龙图腾网获悉安徽大学申请的专利多比特运算模块以及使用了该模块的存内计算电路结构获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115954029B 。

龙图腾网通过国家知识产权局官网在2025-08-29发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310026356.1，技术领域涉及：G11C11/419；该发明授权多比特运算模块以及使用了该模块的存内计算电路结构是由周永亮;周子璇;施琦;杨震;韦一鸣;彭春雨;吴秀龙设计研发完成，并于2023-01-09向国家知识产权局提交的专利申请。

本多比特运算模块以及使用了该模块的存内计算电路结构在说明书摘要公布了：本发明涉及静态随机存储器技术领域，更具体的，涉及多比特运算模块，以及使用了该模块的存内计算电路结构。本发明的多比特运算模块通过计算位线负载电容的放电累加完成了多比特乘累加运算，分比特权重和分离全局位线的设计具有良好的计算并行度和稳定性，具有较高的推理精度，且与后续的量化单元模块配合获得量化输出，可支持深度神经网络中多比特MAC运算。

本发明授权多比特运算模块以及使用了该模块的存内计算电路结构在权利要求书中公布了：1.多比特运算模块，其用于实现多比特乘累加计算，其特征在于，所述多比特运算模块包括： 分比特计算模块一，其包括n个级联计算单元一、n条权重位线一LW[1]～LW[n]； 其中，第k个级联计算单元一包括： NMOS管N1[k]，其栅极连接权重位线一LW[k]，漏极连接计算位线CBL，源极连接节点一X1[k]； NMOS管N2[k]，其栅极连接权重位线一LW[k]，漏极连接计算位线CBLB，源极连接节点二X2[k]；N1[k]、N2[k]的规格相同； NMOS管N3[k]，其栅极连接全局位线GBL，漏极连接节点一X1[k]，源极连接地GND；以及 NMOS管N4[k]，其栅极连接全局位线GBLB，漏极连接节点二X2[k]，源极连接地GND；1≤k≤n； 分比特计算模块二，其包括n个级联计算单元二、n条偶数权重位线二RW[1]～RW[n]； 其中，第k个级联计算单元二包括： NMOS管N5[k]，其栅极连接权重位线二RW[k]，漏极连接计算位线CBL，源极连接节点三X3[k]； NMOS管N6[k]，其栅极连接权重位线二RW[k]，漏极连接计算位线CBLB，源极连接节点四X4[k]；N5[k]、N6[k]的规格相同； NMOS管N7[k]，其栅极连接全局位线GBL，漏极连接节点三X3[k]，源极连接地GND；以及 NMOS管N8[k]，其栅极连接全局位线GBLB，漏极连接节点四X4[k]，源极连接地GND；N7[k]、N8[k]、N3[k]、N4[k]的规格相同，N5[k]宽长比是N1[k]宽长比的h倍； 权重位线二RW[k]、权重位线一LW[k]用于提供权重值；全局位线GBL、GBLB用于提供多比特输入值； 所述多比特运算模块从分比特计算模块一、分比特计算模块二选通列并行工作，接收权重值与多比特输入值，进行多比特乘累加计算；计算位线CBL、CBLB用于通过电压变化量反映多比特乘累加计算结果。

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