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龙图腾网获悉安徽大学;合肥中科君达视界技术股份有限公司申请的专利基于极性加固技术的三节点翻转容忍的锁存器电路、芯片获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120454685B 。

龙图腾网通过国家知识产权局官网在2025-09-19发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510947572.9，技术领域涉及：H03K3/013；该发明授权基于极性加固技术的三节点翻转容忍的锁存器电路、芯片是由赵强;李家庆;施琦;潘冬青;郝礼才;彭春雨;蔺智挺;吴秀龙设计研发完成，并于2025-07-10向国家知识产权局提交的专利申请。

本基于极性加固技术的三节点翻转容忍的锁存器电路、芯片在说明书摘要公布了：本发明公开了基于极性加固技术的三节点翻转容忍的锁存器电路、芯片，涉及集成电路设计技术领域。本发明提供了一种基于极性加固技术的三节点翻转容忍的锁存器电路，包括：上拉管部、下拉管部、信号反相部、C单元部、传输管部、传输门部。本发明采用极性加固、C单元相结合的手段，降低了电路中敏感节点的数量，并与信号反相部、传输管部、传输门部配合使用，使电路具备了完全的SNU自恢复能力、及完全的DNU和TNU容忍能力；本发明的电路在功耗、延迟功耗积、综合抗辐射性能等指标上相较于现有电路均有提升。

本发明授权基于极性加固技术的三节点翻转容忍的锁存器电路、芯片在权利要求书中公布了：1.一种基于极性加固技术的三节点翻转容忍的锁存器电路，其特征在于，包括：上拉管部，其用于结合电源VDD上拉存储节点X1~X8； 下拉管部，其用于结合地GND下拉存储节点X1~X8；其中，X1~X8为N极性加固点； 上拉管部包括：8个PMOS管N1~N4、N9~N12；下拉管部包括：8个NMOS管N5~N8、N13~N16；N1~N4、N9~N12的源极连接VDD；N5~N8、N13~N16的漏极连接GND；N1的漏极、N5的源级、N3的栅极、N6的栅极连接X1；N2的漏极、N6的源级、N4的栅极、N7的栅极连接X2；N3的漏极、N7的源级、N1的栅极、N8的栅极连接X3；N4的漏极、N8的源级、N2的栅极、N5的栅极连接X4；N9的漏极、N13的源级、N11的栅极、N14的栅极连接X5；N10的漏极、N14的源级、N12的栅极、N15的栅极连接X6；N11的漏极、N15的源级、N9的栅极、N16的栅极连接X7；N12的漏极、N16的源级、N10的栅极、N13的栅极连接X8； 信号反相部，其包括：2个反相器INV1~INV2；其中，INV1用于将输入信号D转换成反向输入信号DN；INV2用于将时钟信号CLK转换成反向时钟信号NCK； C单元部，其包括：C单元一、C单元二、C单元三；C单元一包括：2个PMOS管P1~P2、2个NMOS管N25~N26，用于依据X1、X5生成中间信号X9；C单元二包括：2个PMOS管P3~P4、2个NMOS管N27~N28，用于依据X3、X7生成中间信号X10；C单元三包括：3个PMOS管P5~P7、3个NMOS管N29~N31，用于依据X9、X10、CLK、NCK生成输出信号Q； 传输管部，其包括：8个NMOS管N17~N24，用于在CLK=1时使D分别通过N17、N18、N19、N20连通X1、X3、X5、X7，使DN分别通过N21、N22、N23、N24连通X2、X4、X6、X8；以及 传输门部，其包括：1个传输门G1，用于在CLK=1时使D通过G1连通Q。

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