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龙图腾网获悉山东浪潮科学研究院有限公司申请的专利一种众核处理器架构的设计方法、装置、设备及存储介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120386752B 。

龙图腾网通过国家知识产权局官网在2025-09-19发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510885800.4，技术领域涉及：G06F13/24；该发明授权一种众核处理器架构的设计方法、装置、设备及存储介质是由李际升;薛海军;王明圣设计研发完成，并于2025-06-30向国家知识产权局提交的专利申请。

本一种众核处理器架构的设计方法、装置、设备及存储介质在说明书摘要公布了：本发明公开一种众核处理器架构的设计方法、装置、设备及存储介质，涉及分布式计算技术领域；包括：步骤1：将所有核心划分成组，步骤2：对每个核心内部，集成CPU流水线、核内私有内存、硬件FIFO队列以及DMA引擎，步骤3：对每个组内核心按坐标进行标号，利用组内共享内存存储组内处理器的共享数据，通过组内主核心控制组间通信接口进行NoC数据包的收发，用于组内通信，步骤4：根据传输的源处理器组和目标处理器组的核心的坐标，规划组间最优传输路径，用于组间通信；本发明通过自动计算组间最短路径，动态优化NoC传输；采用硬件FIFO和DMA引擎实现低延迟数据传输，组间由主核心通过NoC高效交换数据，实现响应。

本发明授权一种众核处理器架构的设计方法、装置、设备及存储介质在权利要求书中公布了：1.一种众核处理器架构的设计方法，其特征是基于众核处理器，包括： 步骤1：将所有核心划分成组，每个组固定核心数量，指定每个组的主核心与普通核心，组间的主核心通过NoC连接，负责组间通信， 步骤2：对每个核心内部，集成CPU流水线、核内私有内存、硬件FIFO队列以及DMA引擎，利用CPU流水线进行计算以及逻辑任务处理；利用核内私有内存存储计算所需的数据；理由硬件FIFO队列存储普通核心的请求或者主核心的响应；利用DMA引擎在主核心与普通核心之间传输运算或状态数据； 步骤3：对每个组内核心按坐标进行标号，每个组中集成组内共享内存、组间通信接口，利用组内共享内存存储组内处理器的共享数据，通过组内主核心控制组间通信接口进行NoC数据包的收发，用于组内通信， 其中进行组内核心间的数据传输流程如下： 步骤31：通过普通核心向主核心提交请求： 普通核心将请求写入本地硬件FIFO，并标记目标为主核心， 主核心通过中断或轮询检测到请求后，从硬件FIFO中读取消息， 主核心执行请求； 步骤32：通过主核心向普通核心返回操作结果： 主核心完成操作后，判断操作结果是响应还是数据， 若操作结果是响应，则将结果写入主核心本地硬件FIFO，标记目标为发出请求的普通核心； 若操作结果是数据，则通过DMA引擎将结果数据直接传入目标核心的私有内存， 普通核心通过中断或者轮询的方式获取结果； 步骤4：根据传输的源处理器组和目标处理器组的核心的坐标，规划组间最优传输路径，用于组间通信。

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