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龙图腾网获悉江南大学申请的专利面向存算的全局可重构模数转换方法及电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116192143B 。

龙图腾网通过国家知识产权局官网在2025-09-23发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310073171.6，技术领域涉及：H03M1/38；该发明授权面向存算的全局可重构模数转换方法及电路是由虞致国;黄合磊;许鑫;孙一;顾晓峰设计研发完成，并于2023-02-03向国家知识产权局提交的专利申请。

本面向存算的全局可重构模数转换方法及电路在说明书摘要公布了：本发明公开了面向存算的全局可重构模数转换方法及电路，属于集成电路技术领域。为了解决现有的可重构模数转换器面积过大的问题，实现可重构功能的同时减小面积开销，本发明的面向存算的可重构模数转换器包括：可重构全局参考电压产生电路和本地模数转换电路；针对存算阵列中ADC的阵列式应用特点，将实现可重构功能的参考电压产生电路设计成全局复用。模数转换采用开关电容电路实现，避免大量电容带来的面积消耗，提高了存算一体芯片的计算密度。同时，结合逐次逼近的转换策略，实现了较高的转换速度，满足存算一体技术更高算力的需求。

本发明授权面向存算的全局可重构模数转换方法及电路在权利要求书中公布了：1.一种面向存算的可重构模数转换器，其特征在于，所述面向存算的可重构模数转换器包括：可重构全局参考电压产生电路和本地模数转换电路； 所述可重构全局参考电压产生电路包括：全局DAC和分辨率控制逻辑电路；所述分辨率控制逻辑电路根据分辨率控制信号CRM:0和时钟信号CLKC输出DK:0，并且每个周期输出的值为上周期的一半；所述全局DAC将所述分辨率控制逻辑电路输出的数据DK:0转换为对应的电压信号，并输出至全阵列所有本地模数转换电路作为全局参考电压VREF_GDAC； 所述本地模数转换电路包括开关电容电路、运算放大器OPA、比较器及转换逻辑电路； 所述开关电容电路和运算放大器OPA连接，用于对输入信号进行采样，并与所述全局参考电压值VREF_GDAC进行加减操作并将其转移到所述比较器正输入端； 所述比较器用于将所述运算放大器OPA的输出值与参考电压值VREF进行比较，并输出对应位码值； 所述转换逻辑电路用于根据所述比较器输出的二进制码值，判断后续进行的加减操作，生成相应的开关控制信号，并输出量化的数字码； 所述开关电容电路包括：采样开关SAMPLE、采样电容CS、第一切换开关S1、第二切换开关S2、第三切换开关S3、第四切换开关S4、保持电容CH、初始化开关INT和复位开关RST； 所述采样开关SAMPLE一端接输入，另一端依次连接所述采样电容CS、初始化开关INT和运算放大器OPA的负输入端；所述第一切换开关S1和第二切换开关S2一端连接所述全局参考电压VREF_GDAC，另一端分别连接所述采样电容CS的两端；所述第三切换开关S3和第四切换开关S4一端连接所述运算放大器OPA的正输入端，另一端分别连接所述采样电容CS的两端；所述保持电容CH和复位开关RST并联，并且两端分别连接所述运算放大器OPA的负输入端和输出端。

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