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龙图腾网获悉湖南工学院申请的专利用于MEMS陀螺接口芯片的三阶积分器级联前馈ΔΣ-ADC获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114928360B 。

龙图腾网通过国家知识产权局官网在2025-10-24发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210660455.0，技术领域涉及：H03M3/00；该发明授权用于MEMS陀螺接口芯片的三阶积分器级联前馈ΔΣ-ADC是由罗雪莲;谭瑾慧;何淑珍;胡星;蔡晓敏设计研发完成，并于2022-06-13向国家知识产权局提交的专利申请。

本用于MEMS陀螺接口芯片的三阶积分器级联前馈ΔΣ-ADC在说明书摘要公布了：用于MEMS陀螺接口芯片的三阶积分器级联前馈ΔΣ‑ADC，涉及微机电系统MEMS陀螺接口及集成电路技术领域，总体而言，本发明提供了一种具有无局部负反馈级联积分器前馈结构的离散时间型ΔΣ‑ADC，该离散时间型ΔΣ‑ADC采用全差分输入、小信号输出单环单比特量化离散型三阶积分器级联前馈ΔΣ‑ADC结构，能够提高ΔΣ‑ADC的精度和线性度，且其舍弃了传统的输入到量化器通路，简化了电路，在保证高精度和稳定性的前提下既减小了电路面积开销以及非线性对SNR产生的负面影响，又能够有效地实现噪声整形，同时，无局部负反馈的级联积分器前馈结构还能够降低积分器中运算放大器的功耗和设计难度。

本发明授权用于MEMS陀螺接口芯片的三阶积分器级联前馈ΔΣ-ADC在权利要求书中公布了：1.用于MEMS陀螺接口芯片的三阶积分器级联前馈ΔΣ-ADC，其特征在于：采用全差分输入、小信号输出单环单比特量化的离散型三阶积分器级联前馈ΔΣ-ADC结构，其包括第一求和节点、前馈因子a1、前馈因子a2、前馈因子a3、第二求和节点、量化器与DAC模块；由增益因子c1和与其对应的开关、运算放大器构成的第一级积分器；由增益因子c2和与其对应的开关、运算放大器构成的第二级积分器；由增益因子c3和与其对应的开关、运算放大器构成的第三级积分器；前馈因子a1、前馈因子a2、前馈因子a3与第二求和节点构成加法器； 所述第一求和节点、第一级积分器、第二级积分器、第三级积分器、第二求和节点、量化器依次连接； 所述量化器的输出接DAC模块，DAC模块的输出接第一求和节点，第一级积分器的输出接前馈因子a1，第二级积分器的输出接前馈因子a2，第三级积分器的输出接前馈因子a3，前馈因子a1、前馈因子a2、前馈因子a3的输出接第二求和节点； 模拟输入信号经采样后与DAC模块反馈回的量化器单比特流输出送入到第一级积分器作差再积分，再依次经过第二级积分器积分、第三级积分器积分，第一级积分器积分结果经前馈因子a1与第二级积分器积分结果经前馈因子a2及第三级积分器积分结果经前馈因子a3后相加求和，再送量化器量化并输出量化结果； 并且，所述离散型三阶积分器级联前馈ΔΣ-ADC结构包括第一级SC积分器模块、第二级SC积分器模块、第三级SC积分器模块、加法器模块、量化器模块、DAC模块及两个DAC采样电容Cdac； 所述第一级SC积分器模块的正输入端Vip1与负输入端Vin1分别连接至输入Vi的正、负端，所述第一级SC积分器模块的正输出端Vop1与负输出端Von1分别连接至第二级SC积分器模块的正输入端Vip2与负输入端Vin2；所述第二级SC积分器模块的正输出端Vop2与负输出端Von2分别连接至第三级SC积分器模块的正输入端Vip3与负输入端Vin3；所述第一级SC积分器模块的正输出端Vop1、第二级SC积分器模块的正输出端Vop2、第三级SC积分器模块的正输出端Vop3还分别接加法器模块的正输入端Vipa1、Vipa2、Vipa3，所述第一级SC积分器模块的负输出端Von1、第二级SC积分器模块的负输出端Von2、第三级SC积分器模块负输出端Von3还分别接加法器模块的负输入端Vina1、Vina2、Vina3，所述加法器模块的正输出端Vopa连接量化器模块的负输入端Vqn,所述加法器模块的负输出端Vona连接量化器模块正输入端Vqp；所述量化器模块的输出端Q、Qn分别接DAC模块的与非门，所述DAC模块的输出分别对应接两个DAC采样电容Cdac的下极板，所述两个DAC采样电容Cdac的上极板输出Vdacp和Vdacn分别接第一级SC积分器模块正、负输入端的两个采样电容Cs的上极板； 所述第一级SC积分器模块包括两个时序Φ1控制开关、两个时序Φ1a控制开关、两个时序Φ2控制开关、两个时序Φ2a控制开关、两个采样电容Cs、两个积分电容Cf、一个运算放大器OP； 其中一个时序Φ1控制开关的一端连接正输入端Vip1，另一个时序Φ1控制开关的一端连接负输入端Vin1，每个时序Φ1控制开关的另一端均连接一个采样电容Cs的下极板以及一个时序Φ2控制开关的一端，两个时序Φ2控制开关的另一端相连后接至电源VCM端，每个采样电容Cs的上极板均连接一个时序Φ2a控制开关以及一个时序Φ1a控制开关的一端，两个时序Φ1a控制开关的另一端相连后接至电源VCM端，两个时序Φ2a控制开关的另一端各连接一个积分电容Cf的上极板且分别接至运算放大器OP的负输入电压端和正输入电压端，两个积分电容Cf的下极板分别与运算放大器OP的正输出端Vop1与负输出端Von1相连并各自接至第二级SC积分器模块的正输入端Vip2与负输入端Vin2，第一级SC积分器模块的正输出端Vop1与负输出端Von1分别接至加法器模块的正输入端Vipa1与负输入端Vina1； 所述量化器模块包括正输入端Vqp、负输入端Vqn、使能端，所述正输入端Vqp、负输入端Vqn分别接加法器模块的负输出端Vona和正输出端Vopa，使能端接时钟信号clk；所述使能端接入的时钟信号clk的占空比仅为时序Φ1a的一半且在时序Φ1a为高电平的后半段上升，所述量化器模块输出为单比特流且其和时钟信号clk通过与门来控制DAC模块输出电压为高或低，DAC模块输出电压通过DAC采样电容Cdac反馈到ΔΣ-ADC电路输入端； 所述第一级SC积分器模块累积输入信号与DAC信号之差并具有两个输入，当时序Φ1和时序Φ1a有效时，所述采样电容Cs和DAC采样电容Cdac分别对积分器模块输入电压Vip和DAC输出电压Vrefp进行采样，而所述积分电容Cf保持为上一周期的积分结束状态；当时序Φ2和时序Φ2a有效时，存储在所述采样电容Cs和DAC采样电容Cdac中的电荷全都转移到积分电容Cf中。

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