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龙图腾网获悉湖南艾科诺维科技有限公司申请的专利基于FPGA的近似对数似然比计算方法、装置及系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN118869148B 。

龙图腾网通过国家知识产权局官网在2025-10-31发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411050165.X，技术领域涉及：H04L1/00；该发明授权基于FPGA的近似对数似然比计算方法、装置及系统是由刘洋洋;周资伟;王萌设计研发完成，并于2024-08-01向国家知识产权局提交的专利申请。

本基于FPGA的近似对数似然比计算方法、装置及系统在说明书摘要公布了：本发明涉及发明一种基于FPGA的近似对数似然比计算方法、装置及系统。方法包括：通过接收机接收通信数据帧，并将通信数据帧中的训练序列符号与本地训练序列符号进行共轭相乘，获取共轭相乘结果；根据共轭相乘结果应用第一FPGA电路获取信号幅度和噪声功率；根据信号幅度和噪声功率基于max‑log‑map算法获取近似对数似然比的计算关系式；根据信号幅度、噪声功率以及计算关系式应用第二FPGA电路获取通信数据帧的近似对数似然比结果，以根据近似对数似然比结果对通信数据帧中的数据序列进行译码。通过以上方式，能够充分考虑信号幅度和噪声功率对ALLR的影响，有助于提高ALLR计算的准确度，使译码器获得最佳译码性能。

本发明授权基于FPGA的近似对数似然比计算方法、装置及系统在权利要求书中公布了：1.一种基于FPGA的近似对数似然比计算方法，其特征在于，所述近似对数似然比计算方法包括： 通过接收机接收通信数据帧，并将所述通信数据帧中的训练序列符号与本地训练序列符号进行共轭相乘，获取共轭相乘结果； 根据所述共轭相乘结果应用第一FPGA电路获取信号幅度和噪声功率； 根据所述信号幅度和所述噪声功率基于max-log-map算法获取近似对数似然比的计算关系式； 根据所述信号幅度、所述噪声功率以及所述计算关系式应用第二FPGA电路获取所述通信数据帧的近似对数似然比结果，以根据所述近似对数似然比结果对所述通信数据帧中的数据序列进行译码； 所述将所述通信数据帧中的训练序列符号与本地训练序列符号进行共轭相乘，获取共轭相乘结果，包括： 按照发送训练序列星座图对本地训练序列进行映射，并对映射结果取共轭； 通过接收机对所述通信数据帧进行时间和频率同步处理，得到所述通信数据帧中的训练序列符号； 将所述训练序列符号与取共轭后的本地训练序列符号进行复数相乘运算，得到共轭相乘结果； 所述第一FPGA电路包括第一累加求和电路、与所述第一累加求和电路连接的第一右移电路、平方计算电路、与所述平方计算电路连接的第二累加求和电路以及与所述第二累加求和电路连接的第二右移电路，所述根据所述共轭相乘结果应用第一FPGA电路获取信号幅度和噪声功率，包括： 根据训练序列符号个数确定预设数量； 通过所述第一累加求和电路对所述共轭相乘结果的实部进行累加求和，然后应用所述第一右移电路预设数量个比特，得到信号幅度； 通过所述平方计算电路对所述共轭相乘结果的虚部进行平方计算，应用所述第二累加求和电路对平方计算结果进行累加求和，然后应用所述第二右移电路预设数量个比特，得到噪声功率； 所述第二FPGA电路包括除法电路、与所述除法电路连接的第一乘法电路和第二乘法电路、分别与所述第一乘法电路和所述第二乘法电路连接的第一左移电路和第二左移电路，所述根据所述信号幅度、所述噪声功率以及所述计算关系式应用第二FPGA电路获取近似对数似然比结果，包括： 应用所述除法电路计算所述信号幅度与所述噪声功率的比值； 通过所述第一乘法电路计算所述比值与所述通信数据帧中的数据序列的实部的第一乘积，通过所述第二乘法电路计算所述比值与所述数据序列的虚部的第二乘积； 通过所述第一左移电路和所述第二左移电路分别对所述第一乘积和所述第二乘积左移2个比特，得到近似对数似然比结果。

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