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龙图腾网获悉成都玖锦科技有限公司申请的专利一种基于FPGA并行宽带DBI架构的触发控制方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119847282B 。

龙图腾网通过国家知识产权局官网在2025-10-31发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411901332.7，技术领域涉及：G06F1/02；该发明授权一种基于FPGA并行宽带DBI架构的触发控制方法是由张帅;刘俊;李毅红;周明长;刘琳;杨紫荆;邵争光;张跃;邓耀辉;周科吉设计研发完成，并于2024-12-23向国家知识产权局提交的专利申请。

本一种基于FPGA并行宽带DBI架构的触发控制方法在说明书摘要公布了：本发明公开了一种基于FPGA并行宽带DBI架构的触发控制方法，所述基于FPGA并行DBI架构包括多工器、2个子带分解滤波器组、8个子带采集模块、处理卡A和处理卡B；所述触发控制方法包括：S1.输入信号经过多工器后，分别输入到2个子带分解滤波器组；每一个子带分解滤波器组将输入信号分解成4个子带信号，每个子带信号对应于一个子带采集模块；S2.各个子带信号经过对应的子带采集模块进入处理板；S3.实时监测所有子带通路的触发状态；S4.各个子带采集模块如果有触发信号产生，后级处理板具体控制前级子带采集模块的读写控制。本发明选择任何一个通道作为触发源，输入的波形都能正确被触发和稳定显示，并且能够按照预设的触发条件稳定触发波形。

本发明授权一种基于FPGA并行宽带DBI架构的触发控制方法在权利要求书中公布了：1.一种基于FPGA并行宽带DBI架构的触发控制方法，其特征在于：所述基于FPGA并行DBI架构包括多工器、2个子带分解滤波器组、8个子带采集模块、处理板A和处理板B；每一个子带采集模块均包括一个ADC采集卡和一个FPGA采集卡；所述触发控制方法包括： S1.输入信号经过多工器后，分别输入到2个子带分解滤波器组；每一个子带分解滤波器组将输入信号分解成4个子带信号，每个子带信号对应于一个子带采集模块； S2.第一个子带分解滤波器组分解得到的四个子带信号，分别经过对应的子带采集模块的ADC采集卡和FPGA采集卡后，进入处理板A；第二个子带分解滤波器组分解得到的四个子带信号，分别经过对应的子带采集模块的ADC采集卡和FPGA采集卡后，进入处理板B； S3.每个子带采集模块的FPGA采集卡都配有一套独立的触发检测和判断子系统，用于实时监测所有子带通路的触发状态；对于输入的信号，各个子带采集模块的FPGA采集卡检测到有满足用户预设触发条件的触发信号产生，触发标志信号就被激活，确定此刻在该子带采集模块中有触发事件发生； S4.各个子带采集模块如果有触发信号产生，进而将产生的触发信号发送到后级处理板，后级处理板会同时收集前端所有子带采集模块的触发信号，并根据用户预设的通道采集模式和触发源，对触发进行通道选择判断，选择出有效的触发信号，然后产生同步信号组sync_group，对后级处理板对应的子带采集模块进行读写控制； 所述处理板A或处理板B均包括触发通信同步处理模块、触发通道选择及多子带触发判断模块和触发信号控制处理模块； 所述S4包括： S401.触发通信同步处理模块，同步接收各个子带采集模块的触发标志信号，传输给触发通道选择及多子带触发判断模块； S402.触发通道选择及多子带触发判断模块，用于选择有效的触发标志信号送入触发信号控制处理模块； 1触发通道选择及多子带触发判断模块根据通道采集模式进行通道划分；所述通道采集模式包括全带宽模式80GSPS和半带宽40GSPS； 设8个子带信号分别记为子带1~子带8； 若通道采集模式为全带宽模式80GSPS，则： 子带1~4组合为一通道； 子带5~8组合为二通道； 若通道采集模式为半带宽40GSPS，则： 子带1~2组合为一通道； 子带3~4组合为二通道； 子带5~6组合为三通道； 子带7~8组合为四通道； 2触发通道选择及多子带触发判断模块接收用户设置的通道采集模式和触发源，据此确定触发标志信号有效的子带： 若用户设置的通道采集模式为全带宽模式80GSPS，触发源为一通道，则子带1~4的触发标志信号有效； 若用户设置的通道采集模式为全带宽模式80GSPS，触发源为二通道，则子带5~8的触发标志信号有效； 若用户设置的通道采集模式为半带宽40GSPS，触发源为一通道，则子带1~2的触发标志信号有效； 若用户设置的通道采集模式为半带宽40GSPS，触发源为二通道，则子带3~4的触发标志信号有效； 若用户设置的通道采集模式为半带宽40GSPS，触发源为三通道，则子带5~6的触发标志信号有效； 若用户设置的通道采集模式为半带宽40GSPS，触发源为四通道，则子带7~8的触发标志信号有效； 3触发通道选择及多子带触发判断模块在各个子带采集模块的触发标志信号中，存在有效的触发标志信号时，将有效的触发标志信号传输给触发信号控制处理模块； S403.触发信号控制处理模块在接收到有效的触发标志信号后，产生同步控制信号组sync_group，对后级处理板对应的子带采集模块进行读写控制； 所述S403中，触发信号控制处理模块在接收到有效的触发标志信号后，产生同步控制信号组sync_group后，需要进行传输同步控制,传输同步控制完成后，再对后级处理板对应的子带采集模块进行读写控制； 传输同步控制的过程如下： A1、后级处理板发送测试数据给对应的各个子带采集模块的FPGA采集卡，所述测试数据包括测试序列和发送时间； A2、每一个子带采集模块的FPGA采集卡中，本地保存有与后级处理板相同的测试序列，FPGA采集卡在接收测试数据前，首先将测试数据通过延时模块进行延时，然后在进行接收，并对接收时间进行计时，根据计时结果和测试序列的发送时间计算传输的时延，并将接收到的测试序列与本地保存的测试序列进行比较： 若每一个子带采集模块接收到的测试序列均与本地保存的测试序列相同，进入步骤A3； 若存在接收到的测试序列与本地保存的测试序列不同的子带采集模块，则认为目前出现亚稳态，返回步骤A1； A3、各个子带采集模块的FPGA采集卡将计算得到的传输时延传输到上位机，由上位机对延时模块进行调整，保证后级处理板到各个子带采集模块的FPGA采集卡之间的传输时延相同，此时传输同步控制完成； A4、后级处理板向对应的子带采集模块的FPGA采集卡发送同步控制信号组sync_group，实现读写控制。

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