江苏帝奥微电子股份有限公司时颖获国家专利权
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龙图腾网获悉江苏帝奥微电子股份有限公司申请的专利基于芯粒架构的通信时钟与数据相位动态校准电路及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120578617B 。
龙图腾网通过国家知识产权局官网在2025-10-31发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511093384.0，技术领域涉及：G06F13/40；该发明授权基于芯粒架构的通信时钟与数据相位动态校准电路及方法是由时颖;鞠建宏;吕宇强设计研发完成，并于2025-08-06向国家知识产权局提交的专利申请。
本基于芯粒架构的通信时钟与数据相位动态校准电路及方法在说明书摘要公布了：本发明公开了一种基于芯粒架构的通信时钟与数据相位动态校准电路及方法，包含主控MCUDIE和ｎ个被控ASICDIE1～被控ASICDIEn，主控MCUDIE内设置有n+1个全局延迟模块GDL1～GDLn+1，ｎ个被控ASICDIE1～被控ASICDIEn内分别一一对应地设置有本地相位单元LPU1～LPUn。本发明消除因时序路径差异导致的数据采样失效，实现多DIE场景下误码率≤10‑9的可靠通信，大大降低了多DIE同步通讯数据传输误码率。
本发明授权基于芯粒架构的通信时钟与数据相位动态校准电路及方法在权利要求书中公布了：1.基于芯粒架构的通信时钟与数据相位动态校准电路，其特征在于：包含主控MCUDIE和ｎ个被控ASICDIE1～被控ASICDIEn，主控MCUDIE内设置有n+1个全局延迟模块GDL1～GDLn+1，ｎ个被控ASICDIE～被控ASICDIE内分别一一对应地设置有本地相位单元LPU～LPU，全局延迟模块GDL的输入端与主控MCUDIE的输出TX连接，全局延迟模块GDL的输出端与本地相位单元LPU～LPU的输入端连接，本地相位单元LPU～LPU的输出端分别与对应的被控ASICDIE～被控ASICDIE的输入RX连接，被控ASICDIE～被控ASICDIE的输出TX与全局延迟模块GDL～GDLn+1的输入端连接，全局延迟模块GDL～GDLn+1的输出端与主控MCUDIE的输入RX连接。
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