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龙图腾网获悉东南大学申请的专利一种基于波兹编码方案的数字域存内计算电路及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116088792B 。

龙图腾网通过国家知识产权局官网在2025-11-21发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211613285.7，技术领域涉及：G06F7/523；该发明授权一种基于波兹编码方案的数字域存内计算电路及方法是由司鑫;张兆阳;刘斐然;高寅海;郭安;王博;蒲星宇;何圣楠设计研发完成，并于2022-12-15向国家知识产权局提交的专利申请。

本一种基于波兹编码方案的数字域存内计算电路及方法在说明书摘要公布了：本发明是一种基于波兹编码方案的数字域存内计算电路及方法，该电路由多个存算单元在列上重复排列构成，每个存算单元包括4个SRAM存储单元阵列、4个波兹乘法单元阵列、4个多通道加法树单元、1个外部移位加法单元，在列上重复排列的多个存算单元共用1个波兹编码输入单元。SRAM存储单元阵列用于存储计算时需要的权重数据。波兹编码输入单元对外部输入进行波兹编码，波兹乘法单元进行乘操作，多通道加法树单元对多个波兹乘法结果累加，外部移位加法单元对于4个加法树的输出进行移位相加，组合输出多位计算结果。本发明受工艺、电压、温度影响小，计算的速度和准确度高；突破了数字域存内计算周期多的瓶颈，提升吞吐率，实现全精度计算。

本发明授权一种基于波兹编码方案的数字域存内计算电路及方法在权利要求书中公布了：1.一种基于波兹编码方案的数字域存内计算电路，其特征在于：该电路包括全局字线驱动模块、读写端口、时序控制、存算控制、波兹编码输入单元、外部移位加法单元以及由8个在列上重复排列的存算单元构成；每一个存算单元包括包括4个SRAM存储单元阵列、4个波兹乘法单元阵列、4个多通道加法树单元、1个外部移位加法单元，在列上重复排列的多个存算单元共用1个波兹编码输入单元； 所述波兹编码输入单元阵列包括多个波兹编码输入单元，每个波兹编码输入单元将输入的3位特征数据INPUT[2:0]波兹编码为5位特征数据，包括移位互补SHIFTB、取反RESERVEB、置零ZERO，并驱动到存算单元； 所述波兹乘法单元阵列中每级波兹乘法单元对应1个波兹编码输入单元；128个波兹乘法单元与多通道加法树单元的连接关系为，每个波兹乘法单元的部分积PP0、PP1、PP2信号分别连接多通道加法树单元的3位输入数据PP0、PP1、PP2；第2n个波兹乘法单元的3位输出数据PP0、PP1、PP2信号与第2n+1个波兹乘法单元的3位输出数据PP0、PP1、PP2信号相加得到新的4位多通道加法树输出数据PP0、PP1、PP2、PP3，n=0，1，…，63。

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