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龙图腾网获悉高通股份有限公司申请的专利多核存储器控制器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120266104B 。

龙图腾网通过国家知识产权局官网在2025-11-25发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202380080265.4，技术领域涉及：G06F13/16；该发明授权多核存储器控制器是由P·德希穆克;S·托祖尔;V·巴拉昆塔拉姆威斯韦斯瓦拉;J·徐;S·帕拉查拉设计研发完成，并于2023-10-11向国家知识产权局提交的专利申请。

本多核存储器控制器在说明书摘要公布了：本公开内容提供用于以低于存储器时钟的频率操作存储器核心的至少部分以减少功耗及成本的存储器系统的系统、方法及设备。在第一方面中，存储器控制器包括用于调度针对存储器时钟的时钟周期的第一部分的第一存储器操作的第一核心，并且包括用于调度针对存储器时钟的时钟周期的第二部分的第二存储器操作的第二核心。还要求保护和描述了其它方面和特征。

本发明授权多核存储器控制器在权利要求书中公布了：1.一种用于调度存储器操作的装置，包括： 基于第一时钟以存储器控制器时钟频率进行操作的存储器控制器，其中，所述存储器控制器： 包括基于存储器时钟、以存储器时钟频率操作的存储器物理PHY接口和多个核心，所述多个核心中的每一者以小于所述存储器时钟频率的所述存储器控制器时钟频率操作， 通过所述存储器物理PHY接口通过通道耦合到存储器， 被配置为通过所述通道和所述存储器物理PHY接口存取所述存储器中存储的数据，以及 被配置为执行包括以下各项的操作： 由所述多个核心中的第一核心调度针对所述存储器时钟的时钟周期的第一部分的第一存储器操作，其中，所述第一核心包括被配置用于调度至少第一类型的存储器操作的第一逻辑电路，其中，所述第一逻辑电路耦合到第一缓冲器； 由所述多个核心中的第二核心调度针对所述存储器时钟的所述时钟周期的第二部分的第二存储器操作，其中，所述第二核心包括被配置用于调度至少第二类型的存储器操作的第二逻辑电路，其中，所述至少第二类型中的至少一者不同于所述第一类型，其中，所述第二逻辑电路耦合到第二缓冲器；以及 在所述存储器时钟的所述时钟周期期间，通过所述存储器物理PHY接口发送对应于所述第一存储器操作的第一信号和对应于所述第二存储器操作的第二信号，其中，所述存储器物理PHY接口包括：被配置为存储来自所述第一核心的所述第一存储器操作的所述第一缓冲器，以及被配置为存储来自所述第二核心的所述第二存储器操作的所述第二缓冲器。

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