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龙图腾网获悉中国电子科技集团公司第五十八研究所申请的专利一种相位可调的ADPLL电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114826255B 。

龙图腾网通过国家知识产权局官网在2025-11-28发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210514285.5，技术领域涉及：H03L7/085；该发明授权一种相位可调的ADPLL电路是由杨俊浩;沈剑;张礼怿;张沁枫;薛颜;苏小波;蒋颖丹设计研发完成，并于2022-05-12向国家知识产权局提交的专利申请。

本一种相位可调的ADPLL电路在说明书摘要公布了：本发明公开一种相位可调的ADPLL电路，属于数字电路领域，包括鉴相器、失锁检测模块、相位可调模块、数字滤波器、DCO、AFC模块和分频器；其中，所述鉴相器、所述失锁检测模块、所述相位可调模块、所述数字滤波器和所述DCO依次相连，所述失锁检测模块、所述AFC和所述DCO组成环路，所述DCO、所述分频器和是鉴相器组成环路。本发明通过在鉴相器后添加失锁检测模块和相位可调模块，所述失锁检测模块用于产生锁定信号Lock，所述相位可调模块用于产生调整后的相位差信号PD_adj，实现了在ADPLL内部环路中进行相位可调以及对环路是否锁定的监测，而且本发明的电路结构简单，容易实现，可复用性高。

本发明授权一种相位可调的ADPLL电路在权利要求书中公布了：1.一种相位可调的ADPLL电路，其特征在于，包括鉴相器、失锁检测模块、相位可调模块、数字滤波器、DCO、AFC模块和分频器；其中， 所述鉴相器、所述失锁检测模块、所述相位可调模块、所述数字滤波器和所述DCO依次相连，所述失锁检测模块、所述AFC和所述DCO组成环路，所述DCO、所述分频器和所述鉴相器组成环路； 所述鉴相器用于提取参考时钟与反馈时钟之间的相位误差； 所述失锁检测模块判断环路是否实现锁定； 所述相位可调模块用于调整所述鉴相器输出的相位误差；所述数字滤波器用于滤除相位误差中的高频分量； 所述DCO产生与频率控制字相对应的时钟信号； 所述AFC模块用于自动频率校准； 所述分频器将所述DCO产生的时钟信号进行分频，产生反馈时钟至所述鉴相器； 所述失锁检测模块包括D触发器、判断电路、模128计数器、二选一数据选择器MUX1； 由8位整数、32位小数构成的相位差信号PD[39:0]首先经过D触发器对其进行采样，得到采样信号PD_Q[39:0]；然后取其整数位PD_Q[39:32]输入到判断电路，若PD_Q[39:32]大于2，所述判断电路输出值为1的控制信号Flag_AFC到所述AFC模块，表明相位差信号需转到AFC模块进行处理；若PD_Q[39:32]不大于2，所述判断电路输出值为0的控制信号Flag_AFC到AFC模块，表明相位差信号无需转到AFC模块进行处理；若PD_Q[39:32]不等于0，所述判断电路输出值为0的计数器清零信号Flag_Clr至模128计数器，对所述模128计数器进行清零；若PD_Q[39:32]等于0，所述判断电路输出值为1的计数器清零信号Flag_Clr至模128计数器，所述模128计数器正常计数；若模128计数器计满128个周期，则输出值为1的锁定信号Lock，表明环路已经锁定，同时Lock信号控制二选一数据选择器MUX1选择数字地信号GND作为所述模128计数器的时钟输入； 所述判断电路由数值比较器1和数值比较器2构成；采样信号的整数位PD_Q[39:32]分别连接数值比较器1和数值比较器2的一端，所述数值比较器1的另一端连接固定数值8'h2，数值比较器1的输出端输出控制信号Flag_AFC，连接到所述AFC模块；数值比较器2的另一端连接固定数值8'h0，数值比较器2的输出端输出计数器清零信号Flag_Clr，连接到所述模128计数器的清零端Clr。

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