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龙图腾网获悉中国航空无线电电子研究所申请的专利一种嵌入式系统高完整性时钟电路监控系统及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116125847B 。

龙图腾网通过国家知识产权局官网在2025-12-02发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211162378.2，技术领域涉及：G05B19/042；该发明授权一种嵌入式系统高完整性时钟电路监控系统及方法是由邓煜;施佳;曹明华设计研发完成，并于2022-09-23向国家知识产权局提交的专利申请。

本一种嵌入式系统高完整性时钟电路监控系统及方法在说明书摘要公布了：本发明属于数字电子系统技术领域，涉及一种嵌入式系统高完整性时钟电路监控系统，时钟融合单元输入端根据待监控的n个时钟生成一个工作时钟，监控参数设置单元每隔一个计数周期发送一个计数器快照触发信号至时钟快照计数器；时钟频率变换单元将输入的待监控的n个时钟进行分频输出至时钟快照计数器；时钟快照计数器驱动n个计数器对n个分频时钟进行脉冲计数；当接收到计数器快照触发信号后，将n个计数器当前计数值存入n个寄存器中，n个计数器清零；n个寄存器中的计数值输出至时钟状态指示单元；时钟状态指示单元将n个时钟各自对应的计数值分别与各自的数据比较容限对比，在数据比较容限内，则判断该时钟正常，否则指示该时钟不正常。

本发明授权一种嵌入式系统高完整性时钟电路监控系统及方法在权利要求书中公布了：1.一种嵌入式系统高完整性时钟电路监控系统，其特征在于：所述系统包括：时钟融合单元、监控参数设置单元、时钟频率变换单元、时钟快照计数器、时钟状态指示单元； 所述时钟融合单元输入端连接待监控的n个时钟，根据待监控的n个时钟生成一个工作时钟，所述工作时钟包括驱动时钟clk_0和由clk_0分频和倍频得到的其他时钟，所述驱动时钟clk_0驱动监控参数设置单元、时钟频率变换单元、时钟快照计数器、时钟状态指示单元工作；N≥1； 所述监控参数设置单元提供参数设置接口，通过所述参数设置接口设置计数周期、n个时钟各自的频率变换系数和数据比较容限；并将频率变换系数和数据比较容限分别输出至时钟频率变换单元、时钟状态指示单元； 所述监控参数设置单元每隔一个计数周期发送一个计数器快照触发信号至时钟快照计数器； 所述时钟频率变换单元根据n个时钟各自的频率变换系数将输入的待监控的n个时钟进行分频，并将n个分频时钟输出至时钟快照计数器； 时钟快照计数器接收n个分频时钟，并驱动n个计数器对n个分频时钟进行脉冲计数；当接收到计数器快照触发信号后，将n个计数器当前计数值存入n个寄存器中，然后将n个计数器清零并重新开始进行脉冲计数；n个寄存器中的计数值输出至时钟状态指示单元； 时钟状态指示单元将n个时钟各自对应的计数值分别与各自的数据比较容限对比，如果计数值在数据比较容限内，则判断该时钟正常，否则指示该时钟不正常。

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