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龙图腾网获悉浙江大学申请的专利建立时间裕量的修调方法及装置、电子设备、存储介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119167845B 。

龙图腾网通过国家知识产权局官网在2025-12-02发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411226664.X，技术领域涉及：G06F30/33；该发明授权建立时间裕量的修调方法及装置、电子设备、存储介质是由程志渊;刘晨曦;黄平洋设计研发完成，并于2024-09-03向国家知识产权局提交的专利申请。

本建立时间裕量的修调方法及装置、电子设备、存储介质在说明书摘要公布了：本发明提出了一种建立时间裕量的修调方法及装置、电子设备、存储介质，包括对建立时间裕量的一步修复与一步调整，每步基于不同类别的时序路径，首先收集所有建立时间违例的时序路径，修复其建立时间违例，保证数字电路的功能正确性，然后收集建立时间裕量过大的时序路径，调整其建立时间裕量，防止建立时间修复过量，同时降低数字电路的功耗和面积。本发明对每种类别的每一步修调进行具体详细的规定，形成可代码化的修调流程，便于通过存储设备和处理器实现自动化修调，有效提高了修复效率。修调方法中每一步方案的修调程度较小，可以减少反复修调的可能性，提高修调的精确性和稳定性。

本发明授权建立时间裕量的修调方法及装置、电子设备、存储介质在权利要求书中公布了：1.一种建立时间裕量的修调方法，其特征在于，包括： S1：提取数字电路中所有时序路径的时间裕量S，S＝T+Δ-Tco+Tdata-Tsu，式中，T为数字电路的时钟周期，Δ为时钟源到达两个寄存器时钟输入端之间的偏差，即时钟源到达第二个寄存器时钟端的时间Tclk2减到达第一个寄存器时钟端的时间Tclk1，Tco、Tdata分别为时序路径的最大传播延时和最大逻辑延时，Tsu为时序路径的建立时间； S2：针对时间裕量S小于合格阈值Smin的时序路径进行修复，以增加其时间裕量至合格阈值Smin以上，其中，通过修复前的时间裕量S0和时间修复程度ΔS，判断修复后时序路径的时间裕量是否达到Smin以上； S3：修复后，计算数字电路的功耗与面积，若所述功耗大于数字电路功耗要求值Pmax或面积大于面积要求值Amax，则针对时间裕量S大于富余阈值Smax的时序路径进行调整，减小其时间裕量以降低数字电路的功耗至Pmax以下，降低数字电路的面积至Amax以下，其中，通过调整前的时间裕量S0’、功耗P0’、面积A0’和时间调整程度ΔS’、功耗调整程度ΔP’、面积调整程度ΔA’，判断调整后数字电路的功耗是否降至Pmax以下，面积是否降至Amax以下，时序路径的时间裕量是否降至Smax以下并在Smin以上； 其中，针对时间裕量S小于合格阈值Smin的时序路径进行修复，包括： 修复方案a为：在数字电路时序路径的时钟路径中，在时钟源和第二寄存器时钟端之间增加一个缓冲器，增大Tclk2，从而增大时钟源到达两个寄存器时钟输入端之间的偏差Δ，增大建立时间裕量S； 修复方案b为：在数字电路时序路径的数据路径中，将逻辑元件的尺寸增大一个级别，可使元件的驱动能力变强，元件延迟变小，从而减小Tdata，增大建立时间裕量S； 修复方案c为：在数字电路时序路径的数据路径中，将逻辑元件的阈值电压减小一个级别，可使元件延迟变小，从而减小Tdata，增大建立时间裕量S； 其中，针对时间裕量S大于富余阈值Smax的时序路径进行调整，包括： 调整方案a’为：在数字电路时序路径的时钟路径中，在时钟源和第二寄存器时钟端之间去除一个缓冲器，减小Tclk2，从而减小Δ，减小建立时间裕量S，改善功耗和面积； 调整方案b’为：在数字电路时序路径的数据路径中，将逻辑元件的尺寸减小一个级别，从而增大Tdata，减小建立时间裕量S，改善功耗和面积； 调整方案c’为：在数字电路时序路径的数据路径中，将逻辑元件的阈值电压增大一个级别，从而增大Tdata，减小建立时间裕量S，改善功耗和面积。

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