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龙图腾网获悉西安电子科技大学申请的专利一种高电源抑制比的曲率补偿带隙基准电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119987476B 。

龙图腾网通过国家知识产权局官网在2025-12-02发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510087185.2，技术领域涉及：G05F1/567；该发明授权一种高电源抑制比的曲率补偿带隙基准电路是由刘伟峰;郑博文;温裕雄;李文博设计研发完成，并于2025-01-20向国家知识产权局提交的专利申请。

本一种高电源抑制比的曲率补偿带隙基准电路在说明书摘要公布了：本发明公开了一种高电源抑制比的曲率补偿带隙基准电路，其特征在于，包括：伪电源电路、启动电路、主体电路；所述伪电源电路于所述启动电路连接，所述启动电路与所述主体电路连接；相较于传统的带隙基准电路，本发明通过使用伪电源电路技术，提高了带隙基准电压源的电源抑制比，使得基准电压源在电源电压变化时仍能保持稳定；并通过主体电路减小电路中温度系数的线性分量和非线性分量对基准电压的影响，使得带隙基准在宽温度范围内具有较低的温度漂移系数，这对于保持基准电压的稳定性至关重要；并且在不增加电路的规模的前提下，能够有效提高电源的稳定性和可靠性，提升电源整体性能。

本发明授权一种高电源抑制比的曲率补偿带隙基准电路在权利要求书中公布了：1.一种高电源抑制比的曲率补偿带隙基准电路，其特征在于，包括：伪电源电路、启动电路、主体电路；所述伪电源电路于所述启动电路连接，所述启动电路与所述主体电路连接；所述主体电路包括晶体管PM6、晶体管PM7、晶体管PM8、晶体管PM9、晶体管PM10、晶体管PM11、晶体管PM12、三极管Q1、三极管Q2、三极管Q3、运算放大器OP2、运算放大器OP3、运算放大器OP4、电阻R4、电阻R5、电阻R6、电阻R7、电阻R8和晶体管NM5；所述晶体管PM6的源极与伪电源输出电压VREG连接，所述晶体管PM6的漏极与所述运算放大器OP2的正输入端和所述电阻R4的第一端连接，所述晶体管PM6的栅极与所述运算放大器OP2的输出端、所述启动电路的端口、所述晶体管PM7的栅极、所述晶体管PM8的栅极以及所述晶体管PM12的栅极连接；所述晶体管PM7的源极与伪电源输出电压VREG连接，所述晶体管PM7的漏极与所述运算放大器OP2的负输入端、所述运算放大器OP3的负输入端以及所述三极管Q2的发射极连接；所述晶体管PM8的源极与伪电源输出电压VREG连接，所述晶体管PM8的漏极与所述晶体管PM9的漏极、所述运算放大器OP4的正输入端以及所述三极管Q3的发射极连接；所述晶体管PM9的源极与伪电源输出电压VREG连接，所述晶体管PM9的栅极与所述运算放大器OP3的输出端、所述晶体管PM10的栅极以及所述晶体管PM11的栅极连接；所述晶体管PM10的源极与伪电源输出电压VREG连接，所述晶体管PM10的漏极与所述运算放大器OP3的正输入端以及所述电阻R5的第一端连接；所述晶体管PM11的源极与伪电源输出电压VREG连接，所述晶体管PM11的漏极与所述晶体管NM5的漏极以及所述电阻R7的第一端连接；所述晶体管PM12的源极与伪电源输出电压VREG连接，所述晶体管PM12的漏极与所述电阻R7的第二端以及电阻R8的第一端连接；所述晶体管NM5的源极与所述运算放大器OP4的负输入端以及所述电阻R6的第一端连接，所述晶体管NM5的漏极与所述晶体管PM11的漏极以及所述电阻R7的第一端连接，所述晶体管NM5的栅极与所述运算放大器OP4的输出端连接；所述电阻R4的第二端与所述三极管Q1的发射极连接，所述电阻R5的第二端与GND连接，所述电阻R6的第二端与所述GND连接，所述电阻R8的第二端与所述GND连接，所述三极管Q1的基极和集电极均与所述GND连接，所述三极管Q2的基极和集电极均与GND连接，所述三极管Q3的基极和集电极均与所述GND连接； 所述伪电源电路，用于向所述启动电路输出伪电源输出电压VREG，以提高电源抑制比； 所述启动电路，用于根据伪电源输出电压VREG向所述主体电路输出启动电流，以使所述主体电路开始启动； 所述主体电路，用于在根据所述启动电流启动后产生正温度系数电流IPTAT和负温度系数电流ICTAT1，并根据所述正温度系数电流IPTAT和所述负温度系数电流ICTAT1得到一阶补偿后的电流ICON，再根据所述一阶补偿后的电流ICON得到初始基准电压VREF；还用于消除所述初始基准电压中的非线性分量和线性分量，得到最终基准电压VREF’。

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