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龙图腾网获悉西安电子科技大学申请的专利一种应用于高速时域交织ADC的比较器的双模失调校准电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120021160B 。

龙图腾网通过国家知识产权局官网在2025-12-02发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202311544298.8，技术领域涉及：H03M1/10；该发明授权一种应用于高速时域交织ADC的比较器的双模失调校准电路是由丁瑞雪;姬鹏飞;党力;刘术彬;朱樟明设计研发完成，并于2023-11-17向国家知识产权局提交的专利申请。

本一种应用于高速时域交织ADC的比较器的双模失调校准电路在说明书摘要公布了：本发明公开了一种应用于高速时域交织ADC的比较器的双模失调校准电路，包括：校准逻辑、n个通道和可配置电阻串；其中，校准逻辑包括检测逻辑和补偿逻辑；每个通道分别与校准逻辑和可配置电阻串连接；n个通道中的任意一个包括：开关阵列、锁存器阵列和比较器。通过本发明所提出的检测逻辑来减少比较器失调检测过程中的噪声影响；采用多个通道复用一个校准逻辑和可配置电阻串，极大地减少了电路的功耗和面积；可配置电阻串根据得到的外部信号MODESEL对应选择粗校准模式或细校准模式，粗校准模式相较于细校准模式具有更大的校准范围和更快的收敛速度，而细校准模式相较于粗校准模式则具有更高的校准精度。

本发明授权一种应用于高速时域交织ADC的比较器的双模失调校准电路在权利要求书中公布了：1.一种应用于高速时域交织ADC的比较器的双模失调校准电路，其特征在于，包括： 校准逻辑、n个通道和可配置电阻串；其中， 所述校准逻辑包括检测逻辑和补偿逻辑； 每个通道分别与所述校准逻辑和所述可配置电阻串连接； 所述n个通道中的任意一个包括：开关阵列、锁存器阵列和比较器； 所述检测逻辑根据所述比较器的输出结果，判断所述比较器的失调极性，生成失调极性选择信号APSEL和ANSEL，同时生成控制信号OPS和ONS； 所述补偿逻辑根据所述控制信号OPS和ONS生成64位数字码S0~S63； 所述锁存器阵列根据所述64位数字码S0~S63进行锁存，对应生成信号S0L~S63L； 所述开关阵列根据所述信号S0L~S63L控制自身与所述可配置电阻串之间的通断，产生节点电压VCAL； 所述可配置电阻串根据得到的外部信号MODESEL对应选择粗校准模式或细校准模式； 所述开关阵列根据所述失调极性选择信号APSEL、ANSEL和所述节点电压VCAL输出校准端电压VIPC和VINC，实现对所述比较器的失调校准。

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