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龙图腾网获悉东南大学申请的专利具有可重构死区时间控制的谐振栅极驱动电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120825027B 。

龙图腾网通过国家知识产权局官网在2025-12-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511323877.9，技术领域涉及：H02M1/088；该发明授权具有可重构死区时间控制的谐振栅极驱动电路是由钱钦松;盛开;陈明刚;吴凡;谭振东;李文静;刘琦;孙伟锋设计研发完成，并于2025-09-17向国家知识产权局提交的专利申请。

本具有可重构死区时间控制的谐振栅极驱动电路在说明书摘要公布了：本发明公开了一种具有可重构死区时间控制的谐振栅极驱动电路，属于集成电路领域，包括可重构死区时间控制电路和谐振驱动电路。可重构死区时间控制电路由脉冲波产生电路、移位寄存器电路和逻辑运算电路三级级联构成，输入端连接外部控制信号；谐振驱动电路由六个晶体管、两个电感及一个电容构成，输出端连接被驱动电路；脉冲波产生电路包括六组D触发器，输出信号通过移位寄存器电路和至逻辑运算电路形成六路独立控制信号，直接驱动谐振驱动电路六个晶体管开关状态，通过电感与被驱动电路负载电容产生谐振，实现驱动能量回收，并通过改变输入信号的部分脉冲时长实现变频变占空比输出。本发明电路仅依赖一个外部控制信号，就能灵活调控关键参数。

本发明授权具有可重构死区时间控制的谐振栅极驱动电路在权利要求书中公布了：1.一种具有可重构死区时间控制的谐振栅极驱动电路，其特征在于，包括：可重构死区时间控制电路和谐振驱动电路； 所述可重构死区时间控制电路由脉冲波产生电路、移位寄存器电路和逻辑运算电路三级级联构成，输入端连接DSP芯片产生的控制信号PWM1； 所述谐振驱动电路由六个金属氧化物半导体场效晶体管S1~S6、两个电感器L1和L2、以及电容Ce构成，输出端Vgsr1和Vgsr2连接被驱动电路； 所述脉冲波产生电路包括六组同构D触发器DFF1~DFF6，输出信号Q1~Q6至移位寄存器电路；所述移位寄存器电路包含十组级联D触发器DFF7~DFF16和与非门单元，输出信号Q7~Q16通过与非门单元逻辑运算后输入至逻辑运算电路，形成六路独立控制信号G1~G6，输出至谐振驱动电路，直接驱动晶体管S1~S6的开关状态； 所述谐振驱动电路通过电感器L1、L2与被驱动电路负载电容Cgsr1、Cgsr2产生谐振，实现驱动能量回收，并通过改变输入信号PWM1的部分脉冲时长，实现变频变占空比输出； 所述谐振驱动电路包含功率开关网络、谐振能量回收网络和驱动接口单元，晶体管S1、S2为PMOS，晶体管S3、S4、S5、S6为NMOS； 所述功率开关网络中，晶体管S1栅极连接逻辑运算电路输出的控制信号G1，源极连接VCC，漏极连接电感器L1、晶体管S3漏极及输出端Vgsr1； 晶体管S2栅极连接逻辑运算电路输出的控制信号G2，源极连接VCC，漏极连接电感器L2、晶体管S4漏极及输出端Vgsr2； 晶体管S3、S4栅极分别连接逻辑运算电路输出的控制信号G3、G4，源极接地； 所述谐振能量回收网络中，晶体管S5、S6栅极分别连接逻辑运算电路输出的控制信号G5、G6，漏极分别连接电感器L1、L2，源极共接电容Ce同端节点，电容Ce另一端连接地GND； 所述驱动接口单元中，负载电容Cgsr1、Cgsr2一端分别连接谐振驱动电路的两个输出端Vgsr1和Vgsr2，另一端均接地GND； 所述脉冲波产生电路中，输入的控制信号PWM1并行接入六组D触发器DFF1~DFF6的数据端，输出信号Q1~Q6分别经反相器延时链反馈至本级复位端，形成自限时脉冲序列； 所述移位寄存器电路中，前级脉冲波产生电路输出信号Q1~Q6接入本级D触发器DFF7~DFF16的时钟端，输出信号Q7~Q16通过与非门单元逻辑运算后送入下一个D触发器数据端，实现相位步进Δt可调的信号延迟； 所述逻辑运算电路接收移位寄存器电路输出信号Q7~Q16，经组合逻辑合成六路独立控制信号G1~G6输出，直接驱动谐振驱动电路中晶体管S1~S6的栅极时序。

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