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龙图腾网获悉中国电子科技集团公司第五十八研究所申请的专利误码数计算方法、FPGA测试方法和误码率的测试系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120825426B 。

龙图腾网通过国家知识产权局官网在2025-12-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511319429.1，技术领域涉及：H04L43/0823；该发明授权误码数计算方法、FPGA测试方法和误码率的测试系统是由杨琳韵;王涛;赵霖;陈婷婷;薛伟;陈旻琦;万书芹设计研发完成，并于2025-09-16向国家知识产权局提交的专利申请。

本误码数计算方法、FPGA测试方法和误码率的测试系统在说明书摘要公布了：本发明属于电子系统技术领域，特别涉及误码数计算方法、FPGA测试方法和误码率的测试系统。包括：根据转换器精度选择对应的误码数处理机制；将JESD204BC的TX链路层和RX链路层与JESD204PHY物理层之间建立连接，并完成JESD204BCTX链路层和JESD204BCRX链路层之间链路同步；JESD204BC的TX链路层接收来自FPGA上层逻辑的发送信号端生成转换器所需的正弦波数据，且发送信号端将正弦波数据按周期连续循环发送至JESD204BC的TX链路层；本发明能够高效实时地计算链路协议层的误码数，有助于分析链路层是否正常工作。

本发明授权误码数计算方法、FPGA测试方法和误码率的测试系统在权利要求书中公布了：1.一种误码数计算方法，基于FPGA硬件平台，其特征在于，包括： 步骤S1：根据转换器精度选择对应的误码数处理机制；所述转换器精度包括12bit、16bit和24bit； 步骤S2：将JESD204BC的TX链路层和RX链路层与JESD204PHY物理层之间建立连接，并完成JESD204BCTX链路层和JESD204BCRX链路层之间链路同步； 步骤S3：JESD204BC的TX链路层接收来自FPGA上层逻辑的发送信号端生成转换器所需的正弦波数据，且发送信号端将正弦波数据按周期连续循环发送至JESD204BC的TX链路层；所述正弦波数据的一个周期有64个数据，并标识0~63，该数据的位宽与转换器精度一致，且每个数据均不相同； 步骤S4：JESD204BC的RX链路层向FPGA下层逻辑的接收信号端发送转换器的正弦波数据，且接收信号端从JESD204BC的RX链路层连续接收正弦波数据； 步骤S5：发送至接收信号端的转换器正弦波数据有效后，等待1μs延时使正弦波数据稳定，选中此时的数据作为对比起始位，称为转换器数据的起点数据； 步骤S6：将起点数据与每一个参考数据进行比较，若数值相同，则记录此时对应的参考数据标识，并标记marker以形成参考数据的起点标识，然后进入步骤S7；若未找到与起点数据一致的参考数据，则重复步骤S5；所述参考数据的一个周期有64个数据，并标识0~63； 步骤S7：对于每个转换器，转换器数据和参考数据分别从起点数据和从起点标识开始，二者进行按位异或计算，计算结果标记为compare_xor[i]，其位宽与转换器精度一致，i与转换器编号一致； 步骤S8：对于每个转换器的compare_xor[i]，按照流水线的方式，所有比特位进行求和计算，计算结果标记为cvt_bit_cnt[i]； 步骤S9：对于所有转换器，按照流水线的方式，所有cvt_bit_cnt[i]进行求和计算，计算公式为。

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