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龙图腾网获悉西安羚控电子科技有限公司申请的专利基于分布式FPGA的协同加速方法及装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120909805B 。

龙图腾网通过国家知识产权局官网在2025-12-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511445849.4，技术领域涉及：G06F9/50；该发明授权基于分布式FPGA的协同加速方法及装置是由李元元;王成林;田建升设计研发完成，并于2025-10-11向国家知识产权局提交的专利申请。

本基于分布式FPGA的协同加速方法及装置在说明书摘要公布了：本申请公开了一种基于分布式FPGA的协同加速方法及装置，涉及模型加速技术领域，该方法包括：将一个第一FPGA芯片与多个第二FPGA芯片连接构建计算平台；对第一FPGA芯片与多个第二FPGA芯片进行时钟同步，基于第一FPGA芯片接收并解析来自外部系统的原始任务包，将原始任务包分解为多个子任务；监控各个第二FPGA芯片的负载状态，并基于负载状态分配子任务；通过各第二FPGA芯片对子任务进行并行处理，将处理结果反馈给第一FPGA芯片；基于第一FPGA芯片将各处理结果进行校验、整合，得到任务执行结果，将任务执行结果反馈给外部系统。解决了现有模型加速方案的加速效果与性能存在瓶颈，难以满足复杂场景的需求的技术问题。能够提升计算平台的可靠性、灵活性和计算效率。

本发明授权基于分布式FPGA的协同加速方法及装置在权利要求书中公布了：1.一种基于分布式FPGA的协同加速方法，其特征在于，包括： 将一个第一FPGA芯片与多个第二FPGA芯片通过高速通信链路连接，以构建计算平台； 对所述第一FPGA芯片与多个第二FPGA芯片进行时钟同步，基于所述计算平台执行任务处理步骤，以实现任务加速； 其中，所述对所述第一FPGA芯片与多个第二FPGA芯片进行时钟同步，包括：在所述第一FPGA芯片与所述第二FPGA芯片的内部进行金属布线，以构建时钟树；通过第一FPGA芯片接收时钟源的原始时钟信号，经过第一FPGA芯片的第一DCM输出第一时钟信号；将所述第一时钟信号分别传输给所述第二FPGA芯片和自身的反馈输入端；对原始时钟信号与反馈输入端接收的第二时钟信号进行相位检测，并进行相位调整，以对齐所述原始时钟信号与所述第二时钟信号；基于对齐后的第二时钟信号确定第一工作时钟；通过第一FPGA芯片的时钟树将所述第一工作时钟传输给第一FPGA芯片内部的各个寄存器；所述第二FPGA芯片基于接收自第一FPGA芯片的第一时钟信号生成第二工作时钟；通过第二FPGA芯片的时钟树将所述第二工作时钟传输给第二FPGA芯片内部的各个寄存器； 所述在所述第一FPGA芯片与所述第二FPGA芯片的内部进行金属布线，以构建时钟树，包括：以时钟原点为中心，以过中心的第一方向为时钟主干，沿垂直于第一方向的第二方向在时钟主干上延伸出多个时钟支干，在每个时钟支干上延伸出多个第一方向的局部时钟线分别连接于各个寄存器，并分别在时钟主干与时钟支干、时钟支干与局部时钟线的连接处设置可配置开关，以在所述第一FPGA芯片与所述第二FPGA芯片内部的金属布线层中构建所述时钟树； 其中，所述任务处理步骤，包括： 基于所述第一FPGA芯片接收并解析来自外部系统的原始任务包，将所述原始任务包分解为多个子任务； 通过所述第一FPGA芯片监控各个第二FPGA芯片的负载状态，并基于所述负载状态向多个第二FPGA芯片动态分配所述子任务； 通过各所述第二FPGA芯片对子任务进行并行处理，并将处理结果反馈给第一FPGA芯片； 基于所述第一FPGA芯片将各第二FPGA芯片的所述处理结果进行校验、整合，得到任务执行结果，并将任务执行结果反馈给外部系统。

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