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龙图腾网获悉之江实验室申请的专利一种FPGA多板同步信号的UDP发送方法及系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120979594B 。

龙图腾网通过国家知识产权局官网在2025-12-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511493704.1，技术领域涉及：H04J3/06；该发明授权一种FPGA多板同步信号的UDP发送方法及系统是由何小丹;李雪敏;刘志威;沈捷;邹敏设计研发完成，并于2025-10-17向国家知识产权局提交的专利申请。

本一种FPGA多板同步信号的UDP发送方法及系统在说明书摘要公布了：本申请涉及通信技术领域，公开了一种FPGA多板同步信号的UDP发送方法及系统，其中，所述方法包括：将同一子带在连续指定数量的时隙内的数据封装为单子带帧，单子带帧的帧头设有排序时间戳；排序时间戳按照如下方式设置：响应于同步复位信号，各FPGA板卡的排序时间戳的数值完成同步复位；针对复位状态下的任一FPGA，若检测到首路首子带有效信号，则进入运行状态，将对应的排序时间戳的数值更新为初始化值；在运行状态下，每检测到指定次数的首路末子带有效信号，则将排序时间戳的数值按照指定步长递增；若排序时间戳的数值达到预设最大值，则自动归零以实现循环计数。其有益效果是，降低了各FPGA同步输出复杂度和硬件成本。

本发明授权一种FPGA多板同步信号的UDP发送方法及系统在权利要求书中公布了：1.一种FPGA多板同步信号的UDP发送方法，其特征在于，所述方法包括： 根据接收方需求的子带总数以及FPGA单传输接口最大子带容量，确定并行输出路数以及每路子带数量，基于所述子带总数对输入的信道化信号进行筛选，得到有效子带，基于所述并行输出路数以及每路子带数量对所述有效子带进行分配，生成速率匹配的信道化输出信号； 针对所述信道化输出信号中的任一路输出，将同一子带在连续指定数量的时隙内的数据封装为单子带帧，所述单子带帧的帧头设有排序时间戳；其中，排序时间戳按照如下方式设置：响应于同步复位信号，各FPGA板卡的排序时间戳的数值完成同步复位；针对复位状态下的任一FPGA，若检测到首路首子带有效信号，则进入运行状态，将对应的排序时间戳的数值更新为初始化值；在运行状态下，每检测到指定次数的首路末子带有效信号，则将排序时间戳的数值按照指定步长递增；若排序时间戳的数值达到预设最大值，则自动归零以实现循环计数； 为单子带帧添加UDP头部，通过填充机制生成指定长度的UDP数据包； 基于所述UDP数据包，生成IP数据报及以太帧并发送。

如需购买、转让、实施、许可或投资类似专利技术，可联系本专利的申请人或专利权人之江实验室，其通讯地址为：311121 浙江省杭州市余杭区中泰街道科创大道之江实验室；或者联系龙图腾网官方客服，联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。

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