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龙图腾网获悉联发科技(新加坡)私人有限公司申请的专利存算一体装置及相关的方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115617306B 。

龙图腾网通过国家知识产权局官网在2026-01-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210793826.2，技术领域涉及：G06F7/544；该发明授权存算一体装置及相关的方法是由奇坦·德许潘;葛加南·萨希布劳·杰德;高朗·普拉巴卡·纳韦卡;薛承昕;苏希尔·库马尔;郭子杰设计研发完成，并于2022-07-05向国家知识产权局提交的专利申请。

本存算一体装置及相关的方法在说明书摘要公布了：本发明提供了一种使用存储器阵列作为存算一体CIM装置来执行MAC操作的装置和方法，与使用位于存储器阵列外部的处理器的计算相比，其能够实现更高的计算吞吐量、更高的性能和更低的功耗。在一些实施例中，使用被布置成行和列的位单元阵列来提供激活架构以存储表示权重矩阵中的权重值的电荷。读字线RWL还可用于向一行位单元内的位单元提供输入激活值，而读位线RBL被配置为接收来自排成一列的位单元的乘积。一些实施例提供位单元阵列的多个子阵列或块。

本发明授权存算一体装置及相关的方法在权利要求书中公布了：1.一种存算一体装置，其特征在于，包括存储器阵列及一个或多个加法器，其中，该存储器阵列包括多个位单元阵列，每个位单元阵列包括： 被布置成多个行和多个列的多个位单元，每个位单元被配置为根据权重矩阵存储权重，且用于将该权重与输入激活向量的输入激活相乘以产生乘积； 多条读字线RWL，每条RWL沿着行方向延伸，且每条RWL被配置为将该输入激活向量的输入激活提供给相应行的位单元；以及， 多条读位线RBL，每条RBL沿着列方向延伸，且每条RBL被配置为从相应列的位单元接收乘积； 其中，该一个或多个加法器耦接该每个位单元阵列的多条RBL，且被配置为基于从该每个位单元阵列的多条RBL接收到的一些或全部乘积产生乘法累加MAC值； 其中，该一个或多个加法器包括加法器树，该存储器阵列包括第一子阵列和第二子阵列，以及，该存算一体装置还包括： 第一组开关，该第一组开关中的每个开关将该第一子阵列中的对应RBL可切换地耦接到该加法器树；以及， 第二组开关，该第二组开关中的每个开关将该第二子阵列中的对应RBL可切换地耦接到该加法器树； 其中，该第一组开关被配置为相对于该第二组开关以相反的相位接通或断开。

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