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龙图腾网获悉中国科学院高能物理研究所申请的专利一种256通道核脉冲波形采集电子学系统获国家实用新型专利权，本实用新型专利权由国家知识产权局授予，授权公告号为：CN223955980U 。

龙图腾网通过国家知识产权局官网在2026-02-27发布的实用新型授权公告中获悉：该实用新型的专利申请号/专利号为：202520640357.X，技术领域涉及：G05B19/042；该实用新型一种256通道核脉冲波形采集电子学系统是由周魏;章志明;刘彦韬;王培林;胡婷婷;李晓辉;黄先超;魏龙设计研发完成，并于2025-04-07向国家知识产权局提交的专利申请。

本一种256通道核脉冲波形采集电子学系统在说明书摘要公布了：本实用新型公开了一种256通道核脉冲波形采集电子学系统。本系统包括256路核脉冲信号输入接口模块、256路核脉冲信号输入缓冲器模块、256路单端转差分模块、ADC模块、FPGA处理模块、高精度系统可编程时钟模块、高精度系统可编程时钟模块、FPGA‑JESD同步信号扇出模块、GTX数据时钟扇出模块、ADC‑JESD同步信号扇出模块、ADC数据时钟扇出模块，实现了一种256通道、40MHz采样率、12bit采样精度的超高密度核成像电子学系统。

本实用新型一种256通道核脉冲波形采集电子学系统在权利要求书中公布了：1.一种256通道核脉冲波形采集电子学系统，其特征在于，包括 256路核脉冲信号输入接口模块1，用于接收外部输入的256路核脉冲信号； 256路核脉冲信号输入缓冲器模块2，用于缓存所述256路核脉冲信号输入接口模块1输出的256路核脉冲信号； 256路单端转差分模块4，用于对所述256路核脉冲信号输入缓冲器模块2缓存的256路核脉冲信号进行单端转差分处理，得到256路模拟差分信号并输入到ADC模块5； ADC模块5，用于对256路模拟差分信号进行模数变换，得到256路数字差分信号并输入到FPGA处理模块6； FPGA处理模块6，用于对256路数字差分信号进行处理； 高精度系统可编程时钟模块14，用于根据所述FPGA处理模块6的配置产生5路时钟信号；其中，第1路时钟信号作为系统工作时钟输入所述FPGA处理模块6，第2路时钟信号作为FPGA处理模块6的JESD204BSYSREF同步信号进入FPGA-JESD同步信号扇出模块12，第3路时钟信号作为FPGA处理模块6的JESD204B数据时钟信号进入GTX数据时钟扇出模块13，第4路时钟信号作为ADC模块5的JESD204BSYSREF同步信号进入ADC-JESD同步信号扇出模块17，第5路时钟信号作为ADC模块5的JESD204B数据时钟信号进入ADC数据时钟扇出模块18； FPGA-JESD同步信号扇出模块12，用于将来自高精度系统可编程时钟模块14的JESD204BSYSREF同步信号复制8份输入到所述FPGA处理模块6； GTX数据时钟扇出模块13，用于将来自高精度系统可编程时钟模块14的JESD204B数据时钟信号复制8份后输入到FPGA处理模块6； ADC-JESD同步信号扇出模块17，用于将来自高精度系统可编程时钟模块14的JESD204BSYSREF同步信号复制8份后输入到ADC模块5； ADC数据时钟扇出模块18，用于将来自高精度系统可编程时钟模块14的JESD204B数据时钟信号复制8份后输入到ADC模块5。

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