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龙图腾网获悉杭州电子科技大学申请的专利一种基于基-4Booth编码和改进Wallace压缩树的乘法器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119512501B 。

龙图腾网通过国家知识产权局官网在2026-03-17发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411550163.7，技术领域涉及：G06F7/523；该发明授权一种基于基-4Booth编码和改进Wallace压缩树的乘法器是由宋国宾;马琪设计研发完成，并于2024-11-01向国家知识产权局提交的专利申请。

本一种基于基-4Booth编码和改进Wallace压缩树的乘法器在说明书摘要公布了：本发明涉及一种基于基‑4Booth编码和改进Wallace压缩树的乘法器，包括部分积生成模块：通过采用Radix‑4Booth算法将输入乘数重新编码为多个部分积，形成紧凑的部分积阵列；部分积压缩模块：通过利用改进的Wallace树压缩结构，通过两种压缩器对部分积进行快速压缩，降低计算路径延迟；最终求和模块：使用高速加法器对压缩后的部分积进行求和，得到最终的乘法结果。本发明采用基‑4Booth编码算法，使部分积阵列排列规则，减少了电路面积，采用新的3‑2与4‑2压缩器相混合的树型压缩结构来实现Wallace树，提高了压缩效率并降低关键延迟。

本发明授权一种基于基-4Booth编码和改进Wallace压缩树的乘法器在权利要求书中公布了：1.一种基于基-4Booth编码和改进Wallace压缩树的乘法器，其特征在于：所述乘法器包括部分积生成模块、部分积压缩模块和最终求和模块； 所述部分积生成模块：通过采用Radix-4Booth算法将输入乘数重新编码为多个部分积，形成紧凑的部分积阵列； 所述部分积压缩模块：通过利用改进的Wallace树压缩结构，通过两种压缩器对部分积进行快速压缩，降低计算路径延迟； 所述最终求和模块：使用高速加法器对压缩后的部分积进行求和，得到最终的乘法结果； 所述两种压缩器包括进位保留加法器和带进位的一位全加器，两种压缩器的关键路径上都有2个XOR门的延时； 所述改进的Wallace树压缩结构由两个进位保留加法器和两个带进位的一位全加器组成；部分积生成模块产生P0-P7一共8个部分积，P0和P1部分积加1后输入到第一进位保留加法器，P2部分积直接输入到第一进位保留加法器，P3-P5部分积输入到第二进位保留加法器，两个进位保留加法器均输入到第一带进位的一位全加器，第一带进位的一位全加器和P6和P7部分积输入到第二带进位的一位全加器。

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