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龙图腾网获悉中国人民解放军国防科技大学申请的专利面向边缘智能的二值化神经网络专用硬件加速器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121072628B 。

龙图腾网通过国家知识产权局官网在2026-03-17发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511585592.2，技术领域涉及：G06F13/16；该发明授权面向边缘智能的二值化神经网络专用硬件加速器是由陈小文;朱麒瑾;黄诗颖;袁珩洲;吴振宇;郭阳;刘胜;鲁建壮;李晨;刘畅;梁斌;池雅庆设计研发完成，并于2025-10-31向国家知识产权局提交的专利申请。

本面向边缘智能的二值化神经网络专用硬件加速器在说明书摘要公布了：本发明涉及集成电路技术领域中面向边缘智能的二值化神经网络专用硬件加速器，通过以下多层次的优化手段，实现了BNN硬件加速器的高效能并行计算：多体存储器设计与Ping‑Pong缓冲结构，有效重叠数据传输与计算时间，显著提升系统吞吐量；利用分级对齐机制，通过历史寄存器和奇偶存储体设计，系统性地解决了BNN数据流中的位级和地址对齐挑战；采用可重构计算架构，通过动态配置寄存器和数据流路径，实现了对多种BNN计算模式的灵活适配，兼顾了高效率与通用性。这些优化协同作用，确保了BNN专用硬件加速器在资源受限的边缘设备上实现高性能、低功耗和高通用性的部署。

本发明授权面向边缘智能的二值化神经网络专用硬件加速器在权利要求书中公布了：1.一种面向边缘智能的二值化神经网络专用硬件加速器，其特征在于，包括： 异步高速缓存与AXI主机接口，用于通过AXI主机接口从外部存储器读取数据至片上高速缓存，并在计算完成后将结果数据暂存后写回； 异步配置寄存器，用于接收中央处理器的专用指令并按照指令中的参数信息配置各项参数到相应的寄存器中，在参数配置完成后接收到启动信号即触发加速器内部的计算流程启动计算；参数信息包括读写地址、步幅、特征图尺寸、通道数、分块规则及计算类型； 片外数据读写地址控制单元，用于管理外部存储器与片内存储器之间的数据交互，根据预设的分块规则动态生成AXI总线的读写地址和数据长度；片内存储器包括异步多体存储器、异步奇偶交错多体乒乓存储器、异步多体乒乓存储器以及异步串并转换存储器，异步多体存储器用于存储各类全局参数，异步奇偶交错多体乒乓存储器用于存储输入特征图和权重，异步多体乒乓存储器用于存储残差输入，异步串并转换存储器用于存储二值输出和残差输出；其中，异步奇偶交错多体乒乓存储器和异步多体乒乓存储器中采用双存储组的乒乓结构，并且采用的乒乓控制是通过异步FIFO实现跨时钟域通信，在异步奇偶交错多体乒乓存储器内，将连续的物理内存地址划分为奇数地址组和偶数地址组分别存储在两个独立的存储体中，奇偶存储体配置为并行读取； 片内数据读写地址控制单元，用于生成片内存储器各存储单元的读写地址，管理与可重构计算模块之间的数据交互； 数据预处理模块，用于将片内存储器的数据按卷积滑动方式处理为计算块，送入可重构计算模块； 可重构计算模块，包括可重构脉动阵列、可重构池化单元、可重构累加单元及激活单元，用于并行处理各输出通道的数据执行BNN模型的关键计算任务。

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