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龙图腾网获悉深圳鸿芯微纳技术有限公司;上海鸿芯科纳科技有限公司申请的专利一种时钟树综合的方法、计算机可读存储介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121168368B 。

龙图腾网通过国家知识产权局官网在2026-03-17发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511715985.0，技术领域涉及：G06F30/3312；该发明授权一种时钟树综合的方法、计算机可读存储介质是由武花荣;林明豪;王磊设计研发完成，并于2025-11-21向国家知识产权局提交的专利申请。

本一种时钟树综合的方法、计算机可读存储介质在说明书摘要公布了：一种时钟树综合的方法、计算机可读存储介质。该方法包括：获取目标电路的全局时钟树，全局时钟树包括多个时序偏差组，根据各时序偏差组确定各时序偏差组对应的子时钟树，其中，各子时钟树均包括一条公共路径和由公共路径分叉出的若干条非公共路径，公共路径和非公共路径包括若干个元件；针对每一个子时钟树：根据子时钟树的公共路径确定待处理驱动对象；根据若干条非公共路径计算负载中心位置；在负载中心位置插入负载中心元件；当插入的负载中心元件所在的公共路径的元件以及插入的负载中心元件连接的各非公共路径中与负载中心元件相邻的元件不满足预设设计约束时，在待处理驱动对象和所述插入的负载中心元件之间设置若干信号调节单元。

本发明授权一种时钟树综合的方法、计算机可读存储介质在权利要求书中公布了：1.一种时钟树综合的方法,其特征在于，包括： 获取目标电路的全局时钟树，所述全局时钟树包括多个时序偏差组，根据各时序偏差组确定各时序偏差组对应的子时钟树，其中，各子时钟树均包括一条公共路径和由所述公共路径分叉出的若干条非公共路径，所述公共路径和非公共路径包括若干个元件； 针对每一个子时钟树： 沿时钟信号的传输方向，将从所述子时钟树的根节点开始到设定的输出管脚之间的路径确定为公共路径；其中，所述设定的输出管脚为所述时钟信号的传输方向上出现的第一个连接多个下一级元件的输出管脚；将所述第一个连接多个下一级元件的输出管脚确定为待处理驱动对象； 在各非公共路径中选取负载，根据选取的负载的位置坐标计算负载中心位置； 在所述待处理驱动对象不是负载中心元件的情况下： 在所述负载中心位置插入负载中心元件； 当插入的负载中心元件所在的公共路径的元件以及所述插入的负载中心元件连接的各非公共路径中与所述负载中心元件相邻的元件不满足预设设计约束时，在所述待处理驱动对象和所述插入的负载中心元件之间设置若干信号调节单元，以对子时钟树进行优化； 其中，在所述待处理驱动对象和所述插入的负载中心元件之间，按照设定的数量变化条件逐次增加或逐次减少所述信号调节单元的数量，并计算每一次信号调节单元的数量变化时，所述子时钟树的时序；若在每一次信号调节单元的数量变化时，插入的负载中心元件所在的公共路径的元件以及所述插入的负载中心元件连接的各非公共路径中与所述负载中心元件相邻的元件不满足预设设计约束，则确定所述信号调节单元的数量为各次信号调节单元的数量变化中，子时钟树的最优时序对应的信号调节单元的数量；所述信号调节单元包括缓冲器和或反相器。

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