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龙图腾网获悉长沙快子科技有限公司申请的专利一种基于SystemRDL的ISA指令格式拼装方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121143811B 。

龙图腾网通过国家知识产权局官网在2026-04-03发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511461908.7，技术领域涉及：G06F8/41；该发明授权一种基于SystemRDL的ISA指令格式拼装方法是由谢岳林;郭文斌;罗洁;陈程设计研发完成，并于2025-10-14向国家知识产权局提交的专利申请。

本一种基于SystemRDL的ISA指令格式拼装方法在说明书摘要公布了：本发明公开了一种基于SystemRDL的ISA指令格式拼装方法，涉及ISA指令拼装技术领域，包括：建立位域映射，解析操作码与操作数信息，定义域属性，操作码域位宽7至10比特，立即数域8至20比特；扩展指令行为，补充运算逻辑与时序约束，自动拼装；定义操作数属性，寄存器位宽16至64比特，立即数位宽1比特至最大支持宽度；按功能分类拼装，算术运算、访存、控制指令各设对应位域结构；处理宏与伪指令，分解宏指令并排序，映射伪指令功能；三次扫描生成汇编器代码，依次解析、关联、整合输出。本发明提升指令拼装效率与准确性，增强扩展性和兼容性，简化验证与维护，推动处理器开发自动化、标准化。

本发明授权一种基于SystemRDL的ISA指令格式拼装方法在权利要求书中公布了：1.一种基于SystemRDL的ISA指令格式拼装方法，其特征在于，包括： 步骤1：位域映射建立，基于SystemRDL寄存器位域描述规则，解析ISA指令的操作码与操作数信息，定义域名称、位宽、取值范围、编码方式、位域位置、访问权限、默认值及用户自定义属性，位域位置通过位偏移量或高位至低位范围标识，建立与目标机器码位域的一一对应映射； 步骤2：指令行为扩展，通过SystemRDL用户定义规则与扩展描述机制，补充指令运算逻辑、执行时序约束行为描述，通过自动化生成程序拼装指令行为逻辑； 步骤3：操作数属性定义，初始化时明确三类操作数属性，寄存器操作数定义类型、位宽及功能；立即数操作数动态确定位宽，并剔除未用位，适配多数据类型；存储器操作数定义存储类型、地址范围及访问权限； 步骤4：指令格式分类拼装，按指令功能划分位域，功能包括算术运算、访存、控制，算术运算指令设置操作码域加多寄存器地址域加功能码域，访存指令设置操作码域加寄存器地址域加立即数域，控制指令设置操作码域加宽立即数域； 还包括算术运算指令功能码适配步骤，功能码与运算类型一一绑定，定义功能码映射表，funct3为000对应ADD即加法、001对应SLL即左移、010对应SLT即小于比较、011对应SLTU即无符号小于比较、100对应XOR即异或；拼装时根据指令运算类型自动匹配功能码，写入功能码域，结合操作码域实现算术运算指令的精准识别； 还包括指令拼装兼容性适配步骤，针对不同架构ISA，不同架构ISA包括RISC-V、ARM，预设位域配置模板，RISC-V架构算术指令位域为opcode7比特加rs15比特加rs25比特加rd5比特加funct33比特，ARM架构算术指令位域为cond4比特加opcode2比特加S1比特加rn4比特加rd4比特加operand212比特；拼装时根据目标ISA架构自动调用对应模板； 步骤5：宏与伪指令扩展处理，解析宏指令并分解为常规指令序列，分析数据与控制依赖确定执行顺序；伪指令分前言类与尾声类，前言类包括定义程序地址、引入文件，尾声类包括标识程序结束、输出调试信息，完成功能映射； 步骤6：三次扫描生成汇编器代码，首次扫描解析常规指令生成描述文件，二次扫描关联宏指令、伪指令与常规指令，三次扫描整合文件输出可编译源代码。

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