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  • 本发明公开了一种串行通信接口和处理器。其中,串行通信接口包括寄存器和主控制器,还包括动态重构控制器和自适应前向纠错模块;动态重构控制器与寄存器紧密耦合,控制主控制器和自适应前向纠错模块,自动构建预定义格式的命令帧,监测寄存器的数据流,启动带...
  • 本发明涉及计算机总线技术领域,具体公开了一种基于PXIe总线的可扩展分布式板卡结构,包括载板和子板,载板包括FPGA模块、内存模块、闪存模块、电源管理模块、两个高速接口和两个PXIe接口;载板通过两个高速接口与子板连接;第一PXIe接口将同...
  • 本申请公开了一种Type‑C终端集中管控平台,以破除定制转接线依赖,并解决其并发性能不足、供电能力孱弱、端口密度不足的痛点,实现多终端高并发接入场景下高速网络传输与高功率快充真并发。该平台包括主交换单元、两个第一电源转换模块及多个Type‑...
  • 本发明实施例提出一种通信信息转换方法、系统、设备及存储介质,涉及通信技术领域,该方法包括:获取待转换通信信息;若待转换通信信息为写入信息,则获取写入信息的信息帧结构,根据信息帧结构将写入信息拆分映射到芯片对外接口;若待转换通信信息为读取信息...
  • 本发明提供了一种串行器、2N:N串行器及电子设备,该串行器的上拉网络的采样端通过不同的开关耦接至第一输入对管的两端以及第二输入对管的两端,第一输入对管的输入端接收第一输入数据,其第二端依次通过开关以及第一网络接地,第二输入对管的输入端接收第...
  • 本发明提供了一种具有自动时间撮功能的UART架构,属于嵌入式系统设计技术领域,包括:串并转换模块、计时器模块、接收FIFO模块、中断处理模块、寄存器配置模块、发送FIFO模块、并串转换模块和局部并行总线管理模块。该架构在数据接收过程中可自动...
  • 本申请实施例提供了PCIe 设备的自适应管控方法、装置及电子设备。本实施例基于PCIe设备至根联合体的PCIe跳数、该PCIe设备的PCIe链路速度、该PCIe设备的NUMA距离、该PCIe设备是否启用ACS这四个维度,并结合在该PCIe设...
  • 本发明属于处理器芯片设计技术领域,具体公开了一种微系统模块,主要基于多核DSP和高性能FPGA的双处理器架构,包括多核DSP处理器、FPGA处理器、程序存储器、数据存储器、电子履历存储器和复位芯片,其中,多核DSP处理器中的核1、核2与FP...
  • 本公开提供了一种通信处理装置及方法、电子设备、存储介质,该装置包括应用于处理设备的第一处理单元,该装置包括通信控制模块和通信接口模块,通信接口模块包括多个通信接口,通信控制模块被配置为:在存在空闲的第一通信接口的情况下,根据第一处理单元针对...
  • 本发明公开了一种异构多核数据采集与背压传输方法及系统,涉及嵌入式系统技术领域,该方法包括:S1,在采集核上构造分时接力流水线S2,在采集任务中,周期性地从数据源采样,并将样本写入中间消息队列;S3,在摄取任务中,从中间消息队列读取样本并写入...
  • 本公开的实施例提供了一种数据传输装置、数据传输方法以及电子设备。该数据传输装置包括时钟生成模块、相位选择模块以及数据传输模块。时钟生成模块被配置为依次生成相位均匀分布的N个采样结果时钟信号。相位选择模块被配置为基于N个相位均匀分布的采样结果...
  • 本申请涉及人工智能技术领域,尤其涉及一种基于NPU加速的神经网络智能电能质量数据插值方法以及装置,包括:获取通过电能质量训练数据集训练得到的电能质量数据插值网络模型;将训练完成的电能质量数据插值网络模型进行量化和格式转换,之后部署到神经网络...
  • 本公开涉及计算机技术领域,尤其涉及一种跨节点通信系统、方法、电子设备和存储介质,所述系统包括:主机,用于协调多个计算节点的训练任务;多个计算节点,通过网络互相连接,单个计算节点包括流多处理器和专用通信硬件;其中,单个所述计算节点上运行有设备...
  • 本申请公开了一种工作模式切换系统、方法、装置、设备、介质和产品,涉及多节点服务器技术领域,通过在网卡和节点之间设置转接卡,多个网卡与转接卡的各下行连接器连接,多个节点与转接卡的各上行连接器连接。转接卡内部的模式切换部件可以调整多个下行连接器...
  • 本申请公开了一种支持在线升级的CPLD及其在线升级方法。所述CPLD包括:多个复用I/O;Flash,设有用于存储多个复用I/O的特征控制位的存储区域;配置控制系统,被配置为:在CPLD的配置复位引脚由低变高后,获取复用I/O的特征控制位,...
  • 本发明公开了一种基于MRAM的时域存内计算电路,其涉及存内计算技术领域。本发明的MRAM阵列模块兼具存储与计算功能、输入缓冲器生成反相信号实现通路精准选择、通过RC时域延迟映射输入‑权重关系并经列级串行累加生成时延信号、辅助计算逻辑阵列完成...
  • 本发明提供了一种面向LLM推理的P‑D半分离式异构多芯粒集成架构,包括:NPU芯粒,针对Prefill阶段的计算密集型特性,采用并行处理单元,用于对长序列输出进行矩阵运算;DRAM‑PIM芯粒,针对Decode阶段的访存密集型特性,采用片上...
  • 本发明公开了一种封装结构及计算芯片,其中封装结构包括沿垂直方向依次堆叠的存储层、中间层、计算层和封装基板;存储层包括多个第一存储单元;中间层包括缓冲层和第一片上网络;计算层包括多个计算单元;存储层与中间层通过垂直互联结构电气连接,中间层与计...
  • 公开了一种片上系统、异常处理方法、存储介质和电子设备,该片上系统包括:第一处理器核,被配置为:响应于检测到异常事件,通过安全监控调用指令进入特权级别EL3,并通过EL3中运行的可信固件向第二处理器核发送软件生成中断信号;第二处理器核,被配置...
  • 本发明属于信息技术的技术领域,公开了一种基于软件定义无线电和GPU服务器的专用信号发生设备,包括:图形处理单元,用于产生对应多种通信体制和调制方式的高速正交数据流,所述高速正交数据流通过光纤传输至中频信号单元;所述中频信号单元用于接收所述高...
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