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龙图腾网恭喜苏州博创集成电路设计有限公司申请的专利全数字延迟锁相环电路及校准方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119420348B 。

龙图腾网通过国家知识产权局官网在2025-04-08发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510012678.X，技术领域涉及：H03L7/081；该发明授权全数字延迟锁相环电路及校准方法是由王天宇;李健剑;尹平;王天石;刁进科设计研发完成，并于2025-01-06向国家知识产权局提交的专利申请。

本全数字延迟锁相环电路及校准方法在说明书摘要公布了：本申请提供一种全数字延迟锁相环电路及校准方法，涉及集成电路技术领域。该全数字延迟锁相环电路包括：分频器、鉴相器、校准逻辑电路和数控延迟线；分频器的输入端接收参考时钟信号，分频器的第一输出端连接数控延迟线的输入端，提供参考脉冲信号；分频器的第二输出端连接鉴相器的第一输入端，提供鉴相采样脉冲信号；鉴相器的第二输入端连接数控延迟线的输出端，接收数控延迟线对参考脉冲信号延迟后的延迟脉冲信号；鉴相器的输出端连接校准逻辑电路的输入端，提供鉴相结果；校准逻辑电路的输出端连接数控延迟线的控制端，根据鉴相结果校准数控延迟线的延迟步长，以对延迟脉冲信号的延迟进行校准。本申请可以减小鉴相误差，提高校准精度。

本发明授权全数字延迟锁相环电路及校准方法在权利要求书中公布了：1.一种全数字延迟锁相环电路，其特征在于，所述电路包括：分频器、鉴相器、校准逻辑电路和数控延迟线；所述分频器的输入端用于接收参考时钟信号，所述分频器的第一输出端连接所述数控延迟线的输入端，用于为所述数控延迟线提供参考脉冲信号；所述分频器的第二输出端连接所述鉴相器的第一输入端，用于为所述鉴相器提供鉴相采样脉冲信号，所述鉴相采样脉冲信号和所述参考脉冲信号为所述参考时钟信号的两个分频信号；所述鉴相器的第二输入端连接所述数控延迟线的输出端，用于接收所述数控延迟线对所述参考脉冲信号进行延迟后的延迟脉冲信号；所述鉴相器的输出端连接所述校准逻辑电路的输入端，用于为所述校准逻辑电路提供所述参考脉冲信号和所述延迟脉冲信号的鉴相结果；所述校准逻辑电路的输出端连接所述数控延迟线的控制端，用于根据所述鉴相结果校准所述数控延迟线的延迟步长，以对所述延迟脉冲信号的延迟进行校准，所述延迟步长指示所述数控延迟线中有效延迟单元的个数。

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