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龙图腾网获悉上海芯炽科技集团有限公司申请的专利一种多片锁相环时钟芯片同步电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119210435B 。

龙图腾网通过国家知识产权局官网在2025-04-25发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411725159.X，技术领域涉及：H03L7/199；该发明授权一种多片锁相环时钟芯片同步电路是由任兵兵;吴光林设计研发完成，并于2024-11-28向国家知识产权局提交的专利申请。

本一种多片锁相环时钟芯片同步电路在说明书摘要公布了：本发明公开一种多片锁相环时钟芯片同步电路，属于集成电路领域，包括：D触发器DFF0~DFF17、反相器INV1~INV5、与门AND1；本发明通过接收到的片外同步信号，分别控制锁相环的输入分频器、反馈分频器、鉴频鉴相器的复位信号，并依序放开，使多片锁相环重新进行相位对齐至REF_CLK，并且不会导致锁相环失锁，实现多片时钟的同步。

本发明授权一种多片锁相环时钟芯片同步电路在权利要求书中公布了：1.一种多片锁相环时钟芯片同步电路，其特征在于，控制锁相环中输入分频器、反馈分频器、鉴频鉴相器的复位信号，所述多片锁相环时钟芯片同步电路包括：D触发器DFF0~DFF17、反相器INV1~INV5、与门AND1；同步信号CHIP_SYNC输入至D触发器DFF0的时钟端，D触发器DFF0的Q端接D触发器DFF1的D端，D触发器DFF1的Q端接D触发器DFF2的D端，D触发器DFF2的Q端接D触发器DFF3的D端，D触发器DFF3的Q端接D触发器DFF4的D端，D触发器DFF4的Q端接D触发器DFF5的D端，D触发器DFF5的Q端接D触发器DFF6的D端；D触发器DFF1、D触发器DFF2、D触发器DFF3、D触发器DFF5、D触发器DFF10的时钟端接入参考时钟REF_CLK，参考时钟REF_CLK通过反相器INV1接入D触发器DFF4、D触发器DFF6的时钟端；D触发器DFF2的Q端分别连接D触发器DFF7、D触发器DFF8、D触发器DFF9的时钟端；D触发器DFF4的Q端通过反相器INV3连接D触发器DFF7的复位RN端，D触发器DFF5的Q端通过反相器INV4连接D触发器DFF8的复位RN端，D触发器DFF6的Q端通过反相器INV5连接D触发器DFF9的复位RN端；D触发器DFF0的Q端输出同步复位信号RESET_SYNC至D触发器DFF10~DFF17的复位RN端，D触发器DFF11的时钟端连接参考时钟REF_CLK，D触发器DFF11的D端连接自身非Q端和D触发器DFF12的时钟端，D触发器DFF12的D端连接自身非Q端和D触发器DFF13的时钟端，D触发器DFF13的D端连接自身非Q端和D触发器DFF14的时钟端，D触发器DFF14的D端连接自身非Q端和D触发器DFF15的时钟端，D触发器DFF15的D端连接自身非Q端和D触发器DFF16的时钟端，D触发器DFF16的D端连接自身非Q端和D触发器DFF17的时钟端，D触发器DFF16的Q端和D触发器DFF17的Q端分别连接与门AND1的两个输入端，与门AND1的输出端接D触发器DFF10的D端，D触发器DFF10的Q端通过反相器INV2连接D触发器DFF0的复位RN端；D触发器DFF0的D端、D触发器DFF7的D端、D触发器DFF8的D端、D触发器DFF9的D端均连接高电平信号1；D触发器DFF7的Q端输出输入分频器的复位信号RESET_RDIV，D触发器DFF8的Q端输出反馈分频器的复位信号RESET_NDIV，D触发器DFF9的Q端输出鉴频鉴相器的复位信号RESET_PFD。

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