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龙图腾网恭喜成都世源频控技术股份有限公司申请的专利一种提高锁相环稳定工作的电路及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119543926B 。

龙图腾网通过国家知识产权局官网在2025-06-06发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510105104.7，技术领域涉及：H03L7/085；该发明授权一种提高锁相环稳定工作的电路及方法是由曾永贵;赵乾坤设计研发完成，并于2025-01-23向国家知识产权局提交的专利申请。

本一种提高锁相环稳定工作的电路及方法在说明书摘要公布了：本发明公开了一种提高锁相环稳定工作的电路及方法，属于电子技术领域，主要解决锁相环开电工作、参考时钟输入两者间先后顺序不恒定时，造成锁相环工作不稳定的技术问题。该电路包括锁相环，还包括一个输出端与锁相环相连用于将参考时钟功分为两路的一分二功分器，输入端与一分二功分器的另一个输出端相连的检波器，输入端与检波器的输出端相连的比较器，与比较器的输出端相连并与锁相环相连的FPGA控制模块，以及为锁相环和FPGA控制模块供电的供电模块。本发明通过FPGA控制模拟开关为锁相环开电，为锁相环配置寄存器，提高了锁相环工作的稳定性。

本发明授权一种提高锁相环稳定工作的电路及方法在权利要求书中公布了：1.一种提高锁相环稳定工作的电路，包括锁相环，其特征在于，还包括一个输出端与锁相环相连用于将参考时钟功分为两路的一分二功分器，输入端与一分二功分器的另一个输出端相连的检波器，输入端与检波器的输出端相连的比较器，与比较器的输出端相连并与锁相环相连的FPGA控制模块，以及为锁相环和FPGA控制模块供电的供电模块；该电路实现稳定工作的方法如下：S1，利用检波器检测外部输入参考时钟并传输信号至比较器，FPGA控制模块接收比较器的输出电平，如果为低电平则进入步骤S2，如果为高电平则进入步骤S3；S2，FPGA控制模块输出电平控制模拟开关，为锁相环断电；S3，FPGA控制模块输出电平控制模拟开关，为锁相环供电；S4，FPGA控制模块为锁相环配置寄存器，避免锁相环开电工作、参考时钟输入两者间先后顺序不恒定。

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