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申请/专利权人：深圳市紫光同创电子有限公司
摘要：本发明实施例提供的基于FPGA的SDIO接口系统，基于FPGA的SDIO接口系统包括：第一SDIO控制器、第二SDIO控制器、缓冲单元；第一SDIO控制器用于接收第一控制器发送的第一数据，并将第一数据写入缓冲单元，还用于接收第一控制器发送的第一数据读取命令，从缓冲单元读取第二SDIO控制器写入的数据并返回给第一控制器；第二SDIO控制器用于接收第二控制器发送的第二数据，并将第二数据写入缓冲单元，还用于接收第二控制器发送的第二数据读取命令，从缓冲单元读取第一SDIO控制器写入的数据并返回给第二控制器。决了SDIO数据读取的读取速度和可扩展性都较低，同时存在数据丢失导致无法采到预期中的信号的问题。
主权项：1.一种基于FPGA的安全数字输入输出SDIO接口系统，其特征在于，所述基于FPGA的SDIO接口系统包括：设置于FPGA上的第一SDIO控制器、第二SDIO控制器和缓冲单元；所述缓冲单元包括第一缓冲buffer和第二缓冲buffer，所述第一缓冲buffer、第二缓冲buffer采用写入端控制器的时钟作为其写入时钟、采用读取端控制器的时钟作为其读取时钟；所述第一SDIO控制器用于接收第一控制器发送的第一数据，将所述第一数据写入所述第一缓冲buffer，还用于接收所述第一控制器发送的第一数据读取命令，从所述第二缓冲buffer读取所述第二SDIO控制器写入的数据并返回给所述第一控制器；所述第二SDIO控制器用于接收第二控制器发送的第二数据，并将所述第二数据写入所述第二缓冲buffer，接收所述第二控制器发送的第二数据读取命令，从所述第一缓冲buffer读取所述第一SDIO控制器写入的数据并返回给所述第二控制器。
全文数据：
权利要求：
百度查询： 深圳市紫光同创电子有限公司 基于FPGA的SDIO接口系统、控制器桥接方法
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