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申请/专利权人：上海壁仞智能科技有限公司
摘要：本发明提供一种latch电路、二三分频器及HS‑MMD，电路包括：第一三态门、第二三态门和第一反相器；第一三态门的输入端作为latch电路的第一输入端，第一三态门的控制端作为latch电路的第二输入端，第一三态门的控制端用于接收第一时钟信号，第一三态门的输出端作为latch电路的输出端，第一三态门的输出端还连接于第一反相器的输入端，第一反相器的输出端连接于第二三态门的第一输入端，第二三态门的输出端连接于第一三态门的输出端，第二三态门的第二输入端用于接收第二时钟信号。本发明无需设置高速预分频器，MMD直接可以处理来自VCO的信号，有利于PLL的模块化集成，提高了PLL的集成程度。
主权项：1.一种锁存器latch电路，其特征在于，包括：第一三态门、第二三态门和第一反相器；所述第一三态门的输入端作为所述latch电路的第一输入端，所述第一三态门的控制端作为所述latch电路的第二输入端，所述第一三态门的控制端用于接收第一时钟信号，所述第一三态门的输出端作为所述latch电路的输出端，所述第一三态门的输出端还连接于所述第一反相器的输入端，所述第一反相器的输出端连接于所述第二三态门的第一输入端，所述第二三态门的输出端连接于所述第一三态门的输出端，所述第二三态门的第二输入端用于接收第二时钟信号。
全文数据：
权利要求：
百度查询： 上海壁仞智能科技有限公司 latch电路、二三分频器及HS-MMD
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