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申请/专利权人:成都华微电子科技股份有限公司
摘要:本发明提供一种AXI接口写乱序的实现方法,涉及AXI总线技术领域,主要步骤为:对写地址通道,AXI总线发送的地址、命令与对应的AWID存储到写地址移位FIFO中;对写数据通道,AXI总线发送的的数据存储到一个正常的写数据FIFO中;在数据ID即WID与写地址ID即AWID进行匹配后,计算出第一个进入FIFO的同ID命令和数据进行匹配,形成独热码;根据独热码从写地址移位FIFO中得到位置匹配的写数据通道地址;将匹配完成ID的地址取出与数据进行解析,并将取出的AWID返回写响应通道作为BID。本发明在满足AXI3.0协议的同时,抛弃了写交织功能,保留写乱序功能,减轻了设计复杂度与资源面积消耗。
主权项:1.一种AXI接口写乱序的实现方法,其特征在于,包括下述步骤:S1、对写地址通道,AXI总线发送的地址、命令与对应的ID即AWID存储到写地址移位FIFO中;S2、对写数据通道,AXI总线发送的的数据存储到一个正常的写数据FIFO中;S3、在数据ID即WID与写地址ID即AWID进行匹配后,计算出第一个进入FIFO的同ID命令和数据进行匹配,形成独热码;S4、根据独热码从写地址移位FIFO中得到位置匹配的对应写数据通道的地址;S5、将匹配完成ID的地址取出与数据进行解析,并将取出的AWID返回写响应通道作为BID。
全文数据:
权利要求:
百度查询: 成都华微电子科技股份有限公司 一种AXI接口写乱序的实现方法
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