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申请/专利权人：广州万协通信息技术有限公司

摘要：本发明公开了一种基于多种对称算法多Master进行加解密工作的硬件装置，包括利用PCIE输出高速接口作为数据源的Master、利用USB输出高速接口作为数据源的Master、利用SPI和或IIC和或UART低速接口作为数据源的Master，多个Master之间独立工作，互不影响；硬件装置内部设置有多种对称算法，多种对称算法组成一个对称算法核，每个独立的对称算法核都能够调用多种对称算法中的任意一种进行加解密工作；所述硬件装置中设置有资源调度模块。

主权项：1.一种基于多种对称算法多Master进行加解密工作的硬件装置，其特征在于：包括利用PCIE输出高速接口作为数据源的Master、利用USB输出高速接口作为数据源的Master、利用SPI和或IIC和或UART低速接口作为数据源的Master，多个Master之间独立工作，互不影响；硬件装置内部设置有多种对称算法，多种对称算法组成一个对称算法核，每个独立的对称算法核都能够调用多种对称算法中的任意一种进行加解密工作；所述硬件装置中设置有资源调度模块；加解密工作的流程具体为，S11、为利用PCIE输出高速接口作为数据源的Master、利用USB输出高速接口作为数据源的Master、利用SPI和或IIC和或UART低速接口作为数据源的Master分配独立的FIFO空间；且根据高速、低速两种类型Master分配不同大小的FIFO空间；S12、为多个Master分配ID编号，ID编号的位宽与Master数量相等，即N个Master采用N位编码ID，每个Master占据一个有效信息位；该有效信息位为高，则代表该Master的业务通路有效；S13、当硬件装置探测到Master的业务通路有效后，则将该Master的ID、业务类型、待处理数据的长度信息存入该Master的ID索引下的FIFO空间中，并通知资源调度模块进行调度控制，开始存入该Master的数据流；S14、为每个Master的数据流分配独立的RAM数据存储空间，依据该Master的ID进行数据索引流入流出，并为每个Master记录每段数据存入的起始地址；S15、每个Master的数据流运算完毕后，根据每个Master记录每段数据存入的起始地址，将数据进行覆盖，即将记录的数据起始地址作为数据源地址，也作为结果数据地址。

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