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申请/专利权人：灿芯半导体(上海)股份有限公司

摘要：本发明公开了一种应用于ADC下极板采样的输入共模电平保护电路，包括三组开关电容，二个比较器以及相应的逻辑电路组成，二个所述比较器包括比较器i1、比较器i2；第一组开关电容由电容C1P、电容C1N，以及开关ss1、开关ss2、开关sc1、开关sc2组成；第二组开关电容由电容C2P、电容C2P，以及开关ss3、开关ss4、开关sc3、开关sc4组成；第三组开关电容由电容C3P、电容C3P，以及开关ss5、开关ss6、开关sc5、开关sc6组成。本发明中，当超出设定的共模电平范围，提出的电路输出报警信息，并在采样结束之后禁止后续的ADC转换，不会进行采样电容的翻转，因而较大的输入共模电平不会传导到电容的上极板。

主权项：1.一种应用于ADC下极板采样的输入共模电平保护电路，其特征在于，包括三组开关电容，两个比较器以及相应的逻辑电路组成；第一组开关电容由电容C1P、电容C1N，以及开关ss1、开关ss2、开关sc1、开关sc2组成；其中开关ss1的一端连接到ADC的输入信号Vip，另一端连接到开关sc1的一端以及电容C1P的顶板；电容C1P的底板连接到参考电平Vrefn；开关ss2的一端连接到ADC的输入信号Vin，另一端连接到开关sc2的一端以及电容C1N的顶板；电容C1N的底板连接到参考电平Vrefn；开关sc1的另一端以及开关sc2的另一端连接到VCP，其中VCP连接到比较器i1以及比较器i2的正端输入；第二组开关电容由电容C2P、电容C2P，以及开关ss3、开关ss4、开关sc3、开关sc4组成；其中开关ss3的一端连接到ADC的参考电平Vrefp，另一端连接到开关sc3的一端以及电容C2P的顶板；电容C2P的底板连接到参考电平Vrefn；开关ss4的一端连接到参考电平Vrefn，另一端连接到开关sc4的一端以及电容C2N的顶板；电容C2N的底板连接到参考电平Vrefn；开关sc3的另一端以及开关sc4的另一端连接到VCN1，其中VCN1连接到比较器i1负端输入；第三组开关电容由电容C3P、电容C3P，以及开关ss5、开关ss6、开关sc5、开关sc6组成；其中开关ss5的一端连接到ADC的参考电平Vrefp，另一端连接到开关sc5的一端以及电容C3P的顶板；电容C3P的底板连接到参考电平Vrefn；开关ss6的一端连接到参考电平Vrefn，另一端连接到开关sc6的一端以及电容C3N的顶板；电容C3N的底板连接到参考电平Vrefn；开关sc5的另一端以及开关sc6的另一端连接到VCN2，其中VCN2连接到比较器i2负端输入；两个所述比较器包括比较器i1、比较器i2；比较器的输出包括正输入端、负输入端、时钟输入ck端、复位信号rst端以及输出端；比较器i1以及比较器i2的时钟输入端连接在一起，为输入时钟P2经过反相器i6的输出提供；比较器i1以及比较器i2的复位信号都是连接到输入时钟P1上；逻辑电路包括D触发器i3、D触发器i4、与非门i5、反相器i7与门i6；其中比较器i1以及i2的输出信号分别连接到D触发器i3、D触发器i4信号输入D端；D触发器i3、D触发器i4时钟输入端由输入时钟CK1P经过反相器i7的输出端提供；D触发器i3的负输出端QN以及D触发器i4的正输出端Q分别连接到与非门i5的两个输入端；非门i5的输出为报警信号FLG_ERR；报警信号FLG_ERR经过反相器连接到与门i6的输入端；与门i6的另一个输入端连接到CK2；与门i6的输出为输出时钟信号CK2D。

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