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申请/专利权人：南京星问科技有限公司

摘要：本发明公开了一种基于FPGA的以太网PHY芯片代理的方法，包括步骤：S1、确定差异和配置FPGA，设置ARMMDIO通信模块、寄存器表、PHYMDIO通信模块和多个IO口；S2、替代引脚和适配：使用IO口替代引脚；S3、编程进行传输：在ARMMDIO通信模块编写Verilog1程序；在寄存器表编写Verilog2程序；在PHYMDIO通信模块编写Verilog3程序；从ARM发送的数据获得解析数据；从解析数据获得映射数据；从映射数据获取需传输的数据并向以太网PHY芯片传输；S4、测试调整。本发明用IO口代理引脚，解决换芯时的引脚不兼容问题；还编写Verilog程序，提升兼容性和性能。

主权项：1.一种基于FPGA的以太网PHY芯片代理的方法，针对依次连接的ARM、FPGA、以太网PHY芯片B和外部接口，使用以太网PHY芯片A替换以太网PHY芯片B，其特征在于，包括如下步骤：S1、确定差异和配置FPGA：确定以太网PHY芯片A与以太网PHY芯片B之间的引脚功能差异、对外部电路需求差异和内置寄存器操作差异；在FPGA中设置ARMMDIO通信模块、寄存器表、PHYMDIO通信模块和多个IO口，ARMMDIO通信模块用于FPGA与ARM进行数据交互，PHYMDIO通信模块用于FPGA与以太网PHY芯片A进行数据交互，寄存器表用于ARMMDIO通信模块向PHYMDIO通信模块发送寄存器地址和写数据；其中，ARMMDIO通信模块向寄存器表发送数据以及寄存器表向PHYMDIO通信模块发送数据时均采用差分走线；S2、替代引脚和适配：使用FPGA中的一个或多个IO口替代需要新增的引脚；针对步骤S1中的外部电路需求差异，在以太网PHY芯片A和外部接口之间增设匹配电阻和偏置电路，调节匹配电阻和偏置电路以及FPGA中内置的时钟信号，将以太网PHY芯片A和外部接口进行适配；S3、编写程序进行数据传输：在步骤S1的ARMMDIO通信模块中，编写Verilog1程序；在步骤S1的寄存器表中，根据内置寄存器操作差异编写Verilog2程序；在步骤S1的PHYMDIO通信模块中，编写Verilog3程序；其中，Verilog1程序、Verilog2程序和Verilog3程序均采用MDIO数据帧格式；利用Verilog1程序解析ARM向FPGA发送的数据，获得解析数据；利用Verilog2程序将解析数据进行映射，获得映射数据；利用Verilog3程序从映射数据中获取需要传输的数据并向以太网PHY芯片A进行传输；S4、测试调整：将外部接口连接外部测试设备进行测试，外部接口接收步骤S3中需要传输的数据并传输到外部测试设备中，利用测试设备将需要传输的数据与预期数据进行对比，依据对比的结果重新调节匹配电阻、偏置电路和FPGA中内置的时钟信号，返回步骤S3中编写程序进行数据传输的过程，进行循环，直至需要传输的数据满足预期数据后，停止操作。

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