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申请/专利权人:大连海事大学
摘要:本发明公开了一种具有差模和共模无反射特性的平衡式高选择性窄带滤波器,包括:平衡式差分信号输入端口A、平衡式差分信号输出端口B、四段四分之一波长差分连接线、两个共模无反射吸收电阻、两段四分之一波长I级连接线、两段四分之三波长延迟线、两个I级吸收电阻、四段四分之一波长II级连接线、两个II级吸收电阻、四段平行耦合线、两段交叉耦合线和两段微带传输线。本发明所述的具有差模和共模无反射特性的平衡式高选择性窄带滤波器可在单片PCB板上实现,有利于加工集成。除此之外,该滤波器不仅能够有效抑制共模噪声,提升通信系统的电磁兼容特性,而且能够实现信号在差模和共模激励下的无反射吸收特性,并且在滤波器带外引入了传输零点,提升了窄带滤波器的频率选择性,因此非常适合应用于各类平衡式微波系统以提高系统的整体性能。
主权项:1.一种具有差模和共模无反射特性的平衡式高选择性窄带滤波器,其特征在于,包括:平衡式差分信号输入端口A、平衡式差分信号输出端口B、四段四分之一波长差分连接线、两个共模无反射吸收电阻、两段四分之一波长I级连接线、两段四分之三波长延迟线、两个I级吸收电阻、四段四分之一波长II级连接线、两个II级吸收电阻、四段平行耦合线、两段交叉耦合线和两段微带传输线;所述平衡式差分信号输入端口A包括输入端口A+1和输入端口A-2;所述平衡式差分信号输出端口B包括输出端口B+3和输出端口B-4;所述四段四分之一波长差分连接线包括第一差分连接线5、第二差分连接线6、第三差分连接线7和第四差分连接线8;其中所述第一差分连接线5的一端与输入端口A+1相连接、另一端与第二差分连接线6相连接;所述第二差分连接线6的一端与输入端口A-2相连接、另一端与第一差分连接线5相连接;所述第三差分链接线7的一端与输出端口B+3相连接、另一端与第四差分连接线8相连接;所述第四差分连接线8的一端与输出端口B-4相连接、另一端与第三差分连接线7相连接;所述两个共模无反射吸收电阻包括第一共模无反射吸收电阻9和第二共模无反射吸收电阻10;其中所述第一共模无反射吸收电阻9的一端接于第一差分连接线5与第二差分连接线6的连接处、另一端接地;所述第二共模无反射吸收电阻10的一端接于第三差分连接线7与第四差分连接线8的连接处、另一端接地;所述两段四分之一波长I级连接线包括第一I级连接线11和第二I级连接线12;所述第一I级连接线11的一端接于输入端口A+1与第一差分连接线5的连接处、另一端与第一II级连接线17相连接;所述第二I级连接线12的一端接于输出端口B-4与第四差分连接线8的连接处、另一端与第四II级连接线20相连接;所述两段四分之三波长延迟线包括第一延迟线13和第二延迟线14;其中所述第一延迟线13的一端接于输入端口A-2与第二差分连接线6的连接处、另一端与第二II级连接线18相连接;所述第二延迟线14的一端接于输出端口B+3与第三差分连接线7的连接处、另一端与第三II级连接线19相连接;所述两个I级吸收电阻包括第一I级吸收电阻15和第二I级吸收电阻16;所述第一I级吸收电阻15的一端接于第一I级连接线11与第一II级连接线17的连接处、另一端接于第一延迟线13与第二II级连接线18的连接处;所述第二I级吸收电阻16的一端接于第二延迟线14与第三II级连接线19的连接处、另一端接于第二I级连接线12与第四II级连接线20的连接处;所述四段四分之一波长II级连接线包括第一II级连接线17、第二II级连接线18、第三II级连接线19和第四II级连接线20;所述第一II级连接线17的一端与第一I级连接线11相连接、另一端与第一平行耦合线23的C端口1c相连接;所述第二II级连接线18的一端与第一延迟线13相连接、另一端与第二平行耦合线24的C端口2c相连接;所述第三II级连接线19的一端与第二延迟线14相连接、另一端与第三平行耦合线25的C端口3c相连接;所述第四II级连接线20的一端与第二I级连接线12相连接、另一端与第四平行耦合线26的C端口4c相连接;所述两个II级吸收电阻包括第一II级吸收电阻21和第二II级吸收电阻22;所述第一II级吸收电阻21的一端接于第一II级连接线17与第一平行耦合线23的C端口1c的连接处、另一端接于第二II级连接线18与第二平行耦合线24的C端口2c的连接处;所述第二II级吸收电阻22的一端接于第三II级连接线19与第三平行耦合线25的C端口3c的连接处、另一端接于第四II级连接线20与第四平行耦合线26的C端口4c的连接处;所述四段平行耦合线包括第一平行耦合线23、第二平行耦合线24、第三平行耦合线25和第四平行耦合线26;其中所述第一平行耦合线23的A端口1a与第一微带传输线29相连接、第一平行耦合线23的B端口1b与第三平行耦合线25的B端口3b相连接、第一平行耦合线23的C端口1c与第一II级连接线17相连接、第一平行耦合线23的D端口1d与第一交叉耦合线27的E端口1e相连接;所述第二平行耦合线24的A端口2a与第二微带传输线30相连接、第二平行耦合线24的B端口2b与第四平行耦合线26的B端口4b相连接、第二平行耦合线24的C端口2c与第二II级连接线18相连接、第二平行耦合线24的D端口2d与第二交叉耦合线28的E端口2e相连接;所述第三平行耦合线25的A端口3a与第一微带传输线29相连接、第三平行耦合线25的B端口3b与第一平行耦合线23的B端口1b相连接、第三平行耦合线25的C端口3c与第三II级连接线19相连接、第三平行耦合线25的D端口3d与第一交叉耦合线27的F端口1f相连接;所述第四平行耦合线26的A端口4a与第二微带传输线30相连接、第四平行耦合线26的B端口4b与第二平行耦合线24的B端口2b相连接、第四平行耦合线26的C端口4c与第四II级连接线20相连接、第四平行耦合线26的D端口4d与第二交叉耦合线28的F端口2f相连接;所述两段交叉耦合线包括第一交叉耦合线27和第二交叉耦合线28;其中所述第一交叉耦合线27的E端口1e与第一平行耦合线23的D端口1d相连接、第一交叉耦合线27的F端口1f与第三平行耦合线25的D端口3d相连接、第一交叉耦合线27的G端口1g开路、第一交叉耦合线27的H端口1h接地;所述第二交叉耦合线28的E端口2e与第二平行耦合线24的D端口2d相连接、第二交叉耦合线28的F端口2f与第四平行耦合线26的D端口4d相连接、第二交叉耦合线28的G端口2g接地、第二交叉耦合线28的H端口2h开路;所述两段微带传输线包括第一微带传输线29和第二微带传输线30;所述第一微带传输线29的一端与第一平行耦合线23的A端口1a相连接、另一端与第三平行耦合线25的A端口3a相连接;所述第二微带传输线30的一端与第二平行耦合线24的A端口2a相连接、另一端与第四平行耦合线26的A端口4a相连接。
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