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摘要：本发明涉及集成电路技术、模数转换电路等领域，公开了一种可集成ADC电容前台校正功能的高速SAR逻辑电路，分别与CDAC和比较器相连接，具有结构精简，使用器件数量较少，能达到较快的ADC工作速度的技术效果，包括比较器1、晶体管M1、晶体管M2、晶体管M3、晶体管M4及晶体管M_cal，晶体管M1的第二端与晶体管M2的第二端共接，晶体管M2的第一端连接比较器1的输出端，晶体管M1的第三端和晶体管M2的第三端共接且连接晶体管M3的第二端；晶体管M3的第一端和晶体管M_cal的第一端共接且连接电源VDD，晶体管M3的第三端和晶体管M_cal的第三端都连接CDAC和晶体管M4，晶体管M_cal的第二端接入set_dac信号。
主权项：1.一种可集成ADC电容前台校正功能的高速SAR逻辑电路，分别与CDAC和比较器相连接，其特征在于：包括晶体管M1、晶体管M2、晶体管M3、晶体管M4及晶体管M_cal，晶体管M1的第二端与晶体管M2的第二端共接，晶体管M2的第一端连接比较器的输出端，晶体管M1的第三端和晶体管M2的第三端共接且连接晶体管M3的第二端；晶体管M3的第一端和晶体管M_cal的第一端共接且连接电源VDD，晶体管M3的第三端和晶体管M_cal的第三端都连接CDAC和晶体管M4，晶体管M_cal的第二端接入set_dac信号；所述晶体管M1和晶体管M2的第二端接入en信号，晶体管M1的第一端接入电源VDD，其中en信号控制比较器的输出到SAR逻辑电路的开关；所述晶体管M3的第三端和晶体管M_cal的第三端共接直接输出控制CDAC的Vcal信号；所述晶体管M3的第三端和晶体管M_cal的第三端共接经反相器形成控制CDAC的Vout信号；所述晶体管M4的第三端连接晶体管M3的第三端和晶体管M_cal的第三端，晶体管M4的第一端接地，晶体管M4的第二端接入rst信号，其中，rst信号为SAR逻辑电路的复位信号；所述CDAC的输出连接比较器的同相输入端，比较器的反相输入端接地。
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百度查询： 成都铭科思微电子技术有限责任公司 一种可集成ADC电容前台校正功能的高速SAR逻辑电路
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