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申请/专利权人：中国电子科技集团公司第三十八研究所

摘要：本发明公开了一种数字阵列雷达噪声非相干时钟源，包括数字锁相环单元、时钟输出单元及高精度时钟源，所述数字锁相环单元将同步时钟与输出端反馈回来的时钟比较得到相位差以后转换为时钟补偿信号，将该时钟补偿信号与高精度时钟源输出的高精度时钟叠加输出给时钟输出单元，时钟输出单元接收数字锁相环单元输出的时钟信号并进行分频处理，输出多路时钟，高精度时钟源为数字锁相环单元提供采样时钟；本发明的优点在于：非相干噪声占时钟源组合噪声中的主导因素，大幅提高大型数字阵列雷达的合成信噪比得益。

主权项：1.一种数字阵列雷达噪声非相干时钟源，其特征在于，包括数字锁相环单元（1）、时钟输出单元（2）及高精度时钟源（3），所述数字锁相环单元（1）将同步时钟与输出端反馈回来的时钟比较得到相位差以后转换为时钟补偿信号，将该时钟补偿信号与高精度时钟源（3）输出的高精度时钟叠加输出给时钟输出单元（2），时钟输出单元（2）接收数字锁相环单元（1）输出的时钟信号并进行分频处理，输出多路时钟，高精度时钟源（3）为数字锁相环单元（1）提供采样时钟；所述数字锁相环单元（1）包括相差检测子单元（11）、数字环路滤波器（12）、反馈除法器（13）、钳位记录电路（14）、数字逻辑单元以及信号转换子单元（15），所述相差检测子单元（11）检测反馈除法器（13）与同步时钟之间的绝对时间差，将绝对时间差映射为相位差，数字环路滤波器（12）接收相位差并滤除干扰，钳位记录电路（14）保持记录数字环路滤波器（12）的历史输出并将相位差转换为相位码或者频率码作为时钟补偿信号输出给数字逻辑单元，所述数字逻辑单元将高精度时钟源（3）输出的高精度时钟与时钟补偿信号叠加得到逻辑计算结果，信号转换子单元（15）将逻辑计算结果转化为模拟信号以后输出时钟给时钟输出单元（2）并将输出时钟反馈给反馈除法器（13），反馈除法器（13）将输出时钟按照预设比例调整为低频信号后反馈给相差检测子单元（11）；所述相差检测子单元（11）包括时间数字化器和相位频率检测器，所述时间数字化器检测反馈除法器（13）与同步时钟之间的绝对时间差转换为数字信号输出给相位频率检测器，相位频率检测器将数字信号的绝对时间差转换为相位差；所述相差检测子单元（11）包括时序产生器（111）、门控环路振荡器（112）、状态寄存器（113）、测量单元（114）及加法器（115），所述时序产生器（111）产生使能信号控制门控环路振荡器（112）的启停并输出时钟给状态寄存器（113）、测量单元（114）以及加法器（115），门控环路振荡器（112）接收同步时钟以及反馈除法器（13）反馈的信号后与基准时钟进行比较，分别计算同步时钟相比基准时钟在一个时间间隔内跳转次数a1，计算反馈除法器（13）反馈的信号相比基准时钟在一个时间间隔内跳转次数a2，状态寄存器（113）存储门控环路振荡器（112）的比较和计数结果，测量单元（114）将状态寄存器（113）存储的同一时间间隔内跳转次数a1与跳转次数a2相减然后乘以每个跳转次数对应的时间得到同一时间间隔内反馈除法器（13）与同步时钟之间的时间差，加法器（115）将测量单元（114）计算的所有单个时间间隔内的时间差叠加得到反馈除法器（13）与同步时钟之间的绝对时间差，相位频率检测器将绝对时间差映射为相位差后输出给数字环路滤波器（12）。

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