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申请/专利权人：南通大学

摘要：本实用新型公开一种带电流驱动能力的带隙基准电路，包括启动电路、偏置电路、基准核心电路、运算放大器、电流驱动缓冲电路、基准电压产生电路以及开关管。通过上述方式，由带隙基准中电流驱动缓冲电路（P25、P26、P27、N20、N21、N22、N26、R6等构成）提供电流驱动能力，其中，P25、P26、P27、N20、N21、R6支路构成以P26为输入管的PMOS型超级缓冲器；N22、N26支路构成以N26为输入管的缓冲器。两级缓冲器级联构成双缓冲器，增强了带隙基准的电流输出能力；其中，N26为主要的电流提供管，根据应用场景所需要的输出电流范围对N26的尺寸进行缩放。相较于传统的带隙基准电路，具备电流驱动能力，节省版图面积，适用于更多的应用场景。

主权项：1.一种带电流驱动能力的带隙基准电路，其特征在于，包括启动电路、偏置电路、基准核心电路、运算放大器、电流驱动缓冲电路、基准电压产生电路以及开关管；所述启动电路包括P1、P2、P3、P4、P5、P6、N1、N2、N3、N4、N5；所述P1的漏极和N1的漏极短接、P1的栅极和N1的栅极短接，P1、N1构成反相器；所述P2的漏极和P3的源极短接、P3的漏极和P4的源极短接、P4的漏极和P5的源极短接、P5的漏极和N2的漏极短接；P2、P3、P4、P5、N2的栅极短接；P2、P3、P4、P5、N2构成反相器；所述偏置电路包括P7、P8、P9、P10、P11、P12、P13、P14、P15、P16、N6、N7、N9、N10、N11、N12、N13、R3；所述P7的漏极、P7的栅极、P9的栅极、P11的栅极、P13的栅极、P15的栅极短接，P7、P9、P11、P13构成电流镜电路；所述P8的漏极、P8的栅极、P10的栅极、P12的栅极、P14的栅极、P16的栅极短接，P8、P10、P12、P14构成电流镜电路；所述N9的漏极、N9的栅极、N7的栅极短接，构成电流镜电路；所述N6的栅极、N7的漏极、P8的漏极、P8的栅极短接；所述N10的漏极、N10的栅极、N12的栅极、N11的栅极短接；所述N10的源极、N11的漏极短接；N12的漏极、N13的栅极短接；所述基准核心电路包括NPN1、NPN2、R1、R2、R4、R5；所述NPN1的集电极和R1的负端短接；所述NPN2的集电极和R2的负端短接；所述NPN1的基极和NPN2的基极短接；所述NPN1的发射极和R4的正端短接；所述NPN2的发射极和R4的负端、R5的正端短接；所述运算放大器包括P19、P20、P21、P22、P23、P24、N16、N17、N18、N19、NPN3、NPN4；所述P19的漏极和P20的源极短接；所述P20的漏极、NPN3的发射极、NPN4的发射极短接；所述P21的栅极、P23的栅极、P22的漏极、N16的漏极短接；所述P22的栅极和P24的栅极短接；所述P21的漏极和P22的源极短接；所述P23的漏极和P24的源极短接；所述N16的栅极和N17的栅极短接；所述N18的栅极和N19的栅极短接；所述N16的源极、N18的漏极、NPN3的集电极短接；所述N17的源极、N19的漏极、NPN4的集电极短接；所述电流驱动缓冲电路包括P25、P26、P27、N20、N21、N22、N26、R6；所述P25的漏级和P26的源极短接；所述N21的漏极、P27的漏极、P27的栅极、N26的栅极、P26的漏极和N20的漏级短接；所述N20的源级和R6的正端短接；所述N20的栅级和N21的栅极短接；所述N26的源极和N22的漏极短接；所述基准电压产生电路包括R7、R8、R9、Rtrim、N23、N24、N25；所述R7的负端和R8的正端短接；所述R8的负端和R9的正端短接；所述R9的负端和Rtrim的正端短接；所述R7的正端、N23的栅级、N24的栅级、N25的栅级短接。

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