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基于数字锁相环的二倍频电路 

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申请/专利权人:成都电科星拓科技有限公司

摘要:本发明公开了一种基于数字锁相环的二倍频电路。为高效地实现二倍频功能,本发明通过异或倍频器获得第二时钟,并通过占空比校正模块调整第二时钟沿之间的延迟,获得二倍频时钟;并通过数字锁相环延迟二倍频时钟,通过鉴相器比较锁相环输出时钟和二倍频时钟,获得相位误差信号;根据相位误差信号生成DTC码值和延迟控制参数,以对第二时钟的占空比进行校正,获得理想的二倍频时钟。本发明通过反馈方案调整第二时钟的占空比,可以获得功耗低且稳定的二倍频时钟。

主权项:1.一种基于数字锁相环的二倍频电路,用于生成二倍频时钟,其特征在于,包括:异或倍频器,用于接收并延迟参考时钟,获得第一时钟,并将参考时钟和第一时钟在异或门中执行逻辑运算后获得第二时钟;其中,第二时钟中的上升沿被划分为第一分组上升沿和第二分组上升沿,第一分组上升沿中的上升沿和第二分组上升沿中的上升沿依次交替出现;占空比校正模块,用于接收第二时钟和DTC码值,输出二倍频时钟;数字锁相环,用于接收二倍频时钟和延迟控制参数,输出锁相环输出时钟;鉴相器,用于接收二倍频时钟和锁相环输出时钟,输出相位误差信号;此外,占空比参数计算模块,用于根据相位误差信号生成DTC码值,用于控制占空比校正模块中的DTC,以调整第一分组上升沿中的上升沿和第二分组上升沿中的上升沿之间的延迟;延迟计算模块,用于根据相位误差信号生成延迟控制参数,用于控制数字锁相环对数字锁相环接收的二倍频时钟的延迟。

全文数据:

权利要求:

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