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申请/专利权人：美光科技公司

摘要：公开了一种推理引擎电路架构，其包含矩阵‑矩阵MM处理器电路和具有多种操作模式的MM加速器电路，以提供完整的矩阵乘法运算。一种代表性MM加速器电路包含：第一缓冲器电路，其存储映射数据；第一数据网络；多个第二缓冲器电路，其各自存储不同的内核数据；多个第二串行数据网络，其各自耦合到对应的第二缓冲器电路；以及多个向量‑向量VV加速电路，其布置在多个阵列中。每个VV加速电路包含：乘法和累加电路；移位寄存器；控制多路复用器，其响应于模式控制字而提供偏置参数或第一累加和的所选择输出；以及第二加法器电路，其将乘积与所述偏置参数或所述第一累加和相加以生成第二或下一累加和。

主权项：1.一种加速电路，其能够连接到存储器电路，所述加速电路包括：第一数据网络，其能够连接到所述存储器电路；第一缓冲器电路，其经配置以存储映射数据；第二数据网络，其耦合到所述第一缓冲器电路；第二缓冲器电路，其经配置以存储内核数据；多个向量-向量加速电路，其布置在阵列中，所述多个向量-向量加速电路中的每个向量-向量加速电路包括：多个乘法和累加电路，其布置在第一阵列中并且通过所述第二数据网络耦合到所述第一缓冲器电路，所述多个乘法和累加电路中的每个乘法和累加电路包括：乘法器电路，其经配置以将映射数据和内核数据相乘以生成乘积；以及第一加法器电路，其耦合到所述乘法器电路且经配置以通过将所述乘积与第一偏置参数或与第一累加和的反馈相加以生成所述第一累加和；移位寄存器，其耦合到所述多个乘法和累加电路；第一控制多路复用器，其经配置以响应于多个模式控制字中的对应模式控制字而提供所选择第一多路复用器输出，所述所选择第一多路复用器输出包括所述第一偏置参数或者所述第一累加和；第二控制多路复用器；以及第二加法器电路，其耦合到所述移位寄存器和所述第二控制多路复用器，所述第二加法器电路经配置以通过将所述第一累加和与所述第二控制多路复用器的第二多路复用器输出相加以生成第二累加和，其中所述第二多路复用器输出包括第二偏置参数或所述第二累加和；以及第三串行数据网络，其耦合到所述第二缓冲器电路和所述阵列的所述多个向量-向量加速电路，所述第三串行数据网络经配置以将内核数据提供到所述阵列的所述多个向量-向量加速电路中的第一向量-向量加速电路，且循序将所述内核数据提供到所述阵列的所述多个向量-向量加速电路中的每个下一向量-向量加速电路。

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