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申请/专利权人：珠海錾芯半导体有限公司
摘要：本发明涉及一种集成电路优化系统和方法，该方法包括将边沿触发的时序元件比如，触发器转换为包含多相电平敏感锁存器的等效模块，继而采用某些基于电平敏感锁存器的优化技术，比如电平敏感锁存器重定时、和基于预测或者检测通过电平敏感锁存器的信号传输的优于最坏情况设计。
主权项：1.一种针对包含边沿触发时序元件的集成电路的优化方法，所述优化方法包含以下步骤：a.将边沿触发时序元件转换为包含多相电平敏感锁存器的等效模块；b.在所述集成电路的电路结构中移动所述电平敏感锁存器中的一个电平敏感锁存器，其中，被转换的边沿触发时序元件在时序关键路径的起始端，所述优化方法还包含以下步骤：c.通过遍历网表，从被移动的电平敏感锁存器的输入出发，到时序元件或初始输入结束，找到被移动的电平敏感锁存器的扇入锥；d.在所述扇入锥的输入端的任何初始输入中插入边沿触发时序元件，然后将所述扇入锥的输入端的每一个边沿触发时序元件转换为包含多相电平敏感锁存器的等效模块；e.移除在所述扇入锥的输入端的某个特定时钟相位的电平敏感锁存器；f.在所述扇入锥的输出端插入所述时钟相位的电平敏感锁存器。
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权利要求：
百度查询： 珠海錾芯半导体有限公司 基于多相电平敏感锁存器的集成电路优化系统和方法
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