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申请/专利权人：北京计算机技术及应用研究所

摘要：本发明涉及一种基于FPGA的DP转HDMI高速接口转换系统和方法，属于视频转换技术领域。本发明的系统包括：Microblaze处理器模块、AXI_Interconnect1IP核、AXI_Interconnect2IP核、DPVideoPHYController模块、DisplayPortRXSubsystem模块、音频流数据处理模块、视频流数据处理模块、VideoTPGIP核、HDMITransmitterSubsystem模块、HDMIVideoPHYController模块、DDR3总线控制模块以及中断处理模块。本发明实现DP1.2的接口视频转换到HDMI2.0接口进行视频显示，本发明的方法工作稳定，达到预期速率，误码率小,可以达到替代专用ASIC芯片的要求，满足DP转HDMI的高速接口转换技术国产化的需求。

主权项：1.一种基于FPGA的DP转HDMI高速接口转换系统，其特征在于，该系统包括：Microblaze处理器模块、AXI_Interconnect1IP核、AXI_Interconnect2IP核、DPVideoPHYController模块、DisplayPortRXSubsystem模块、音频流数据处理模块、视频流数据处理模块、VideoTPGIP核、HDMITransmitterSubsystem模块、HDMIVideoPHYController模块、DDR3总线控制模块以及中断处理模块；Microblaze处理器模块，用于完成对所属的模块进行配置和DP转HDMI的高速接口转换技术软件控制，是整个转换技术设计中最主要的部分；DPVideoPHYController模块，用于从DP接口接收4K高清视频实现视频解串功能；DisplayPortRXSubsystem模块，用于实现视频解码功能，输出视频流和音频流；VideoTPGIP核，连接视频流数据处理模块和HDMITransmitterSubsystem模块，用于系统测试，在没有外部AXI4-Stream视频流进入时输出彩条视频；音频流数据处理模块，连接DisplayPortRXSubsystem模块和HDMITransmitterSubsystem模块，用于完成音频数据的缓存，时钟转换；视频流数据处理模块，连接DisplayPortRXSubsystem模块、VideoTPGIP核和DDR3总线控制模块，用于完成视频数据与DDR3存储器的读写及时钟转换；HDMITransmitterSubsystem模块，用于完成4K高清视频的编码工作，输出3路AXI4-Stream视频流和DDC控制信号；HDMIVideoPHYController模块，连接HDMITransmitterSubsystem模块，用于完成4K高清视频并转串的串化工作，并输出到HDMI接口；中断处理模块，用于将DPVideoPHYController、DisplayPortRXSubsystem模块、HDMIVideoPHYController以及HDMITransmitterSubsystem模块所输出的中断信号进行处理后，发送给Microblaze处理器模块后完成中断函数响应。

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