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申请/专利权人：辛塔拉股份公司
摘要：本公开涉及一种混合时间共享迭代乘法累加电路，包括：乘积存储电路；乘法电路，所述乘法电路可操作以接收第一输入值、接收第二输入值、产生所述第一输入值与所述第二输入值的乘积，以及将所述乘积存储在所述乘积存储电路中；累加器存储电路，用于存储累加的值；以及累加开关，所述累加开关将所述乘积存储电路连接到所述累加器存储电路，所述累加开关可操作从而将所述乘积存储电路与所述累加器存储电路电并联连接，或者将所述乘积存储电路与所述累加器存储电路电断开。
主权项：1.一种时间共享乘法累加电路包括：乘积存储电路；乘法电路，所述乘法电路可操作以接收第一输入值、接收第二输入值、产生所述第一输入值与所述第二输入值的乘积，以及将所述乘积存储在所述乘积存储电路中；累加器存储电路，用于存储累加的值；以及累加开关，所述累加开关将所述乘积存储电路连接到所述累加器存储电路，所述累加开关可操作从而将所述乘积存储电路与所述累加器存储电路电并联连接，或者将所述乘积存储电路与所述累加器存储电路电断开。
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