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申请/专利权人：荣耀终端有限公司

摘要：本申请提供移位寄存器、栅极驱动电路、显示面板及电子设备。包括节点控制模块，与接收低电平的第一电平信号接收端、接收高电平的第二电平信号接收端、第一、第二时钟信号端、第一、第二节点电连接；输入模块，与第二时钟信号端、触发信号输入端和第二节点电连接；稳压模块，与第二、第三节点、第二时钟信号端电连接；输出模块，与第一、第二电平信号接收端、驱动信号输出端和第一、第三节点电连接；当驱动信号输出端输出的信号为低电平时，第三节点的信号的电位小于第一电平信号接收端接收的低电平的电位；节点控制模块包括至少一个有源层为氧化物半导体的晶体管；输入模块、稳压模块和输出模块中的至少一者中包括至少一个有源层为硅的晶体管。

主权项：1.一种显示面板，其特征在于，包括至少两个栅极驱动电路，其中一个栅极驱动电路为发光控制驱动电路，另一个栅极驱动电路为扫描驱动电路；所述栅极驱动电路包括相互级联的N个移位寄存器，N≥2；所述移位寄存器包括：节点控制模块，与第一电平信号接收端、第二电平信号接收端、第一时钟信号端、第二时钟信号端、第一节点和第二节点电连接；输入模块，与所述第二时钟信号端、触发信号输入端和所述第二节点电连接；稳压模块，与所述第二节点、所述第一时钟信号端和第三节点电连接；输出模块，与所述第一电平信号接收端、所述第二电平信号接收端、所述第一节点、所述第三节点和驱动信号输出端电连接；所述输入模块用于接收所述触发信号输入端的输入信号，并响应于所述第二时钟信号端接收的第二时钟信号而控制所述第二节点的信号；所述节点控制模块用于接收所述第一电平信号接收端接收的第一电平信号和所述第二电平信号接收端接收的第二电平信号，并响应于所述第二节点的信号、所述第一时钟信号端接收的第一时钟信号和所述第二时钟信号端接收的第二时钟信号，控制所述第一节点的信号；所述输出模块用于接收所述第二电平信号接收端接收的第二电平信号，并响应于所述第一节点的信号，控制所述驱动信号输出端输出的信号；或者，所述输出模块用于接收所述第一电平信号接收端的第一电平信号，并响应于所述第三节点的信号，控制所述驱动信号输出端输出的信号；所述稳压模块用于接收所述第二节点的信号，并响应于所述第一时钟信号端接收的所述第一时钟信号，控制所述第三节点的信号；其中，所述第一电平信号为低电平信号，所述第二电平信号为高电平信号；当所述驱动信号输出端输出的信号为低电平信号时，所述第三节点的信号的电位小于所述第一电平信号接收端接收的第一电平信号的电位；所述输入模块、所述稳压模块和所述输出模块中的至少一者中包括至少一个有源层为硅的晶体管；所述节点控制模块包括：第一控制单元，与所述第一电平信号接收端、所述第一时钟信号端、所述第二时钟信号端、所述第一节点和所述第二节点电连接；第二控制单元，与所述第二电平信号接收端、所述第一节点和所述第二节点电连接；所述第一控制单元用于接收所述第一电平信号接收端的第一电平信号，并响应于所述第二节点的信号、所述第一时钟信号端接收的第一时钟信号和所述第二时钟信号端接收的所述第二时钟信号，控制所述第一节点的信号；或者，所述第二控制单元用于接收所述第二电平信号接收端接收的第二电平信号，并响应于所述第二节点的信号，控制所述第一节点的信号；所述第一控制单元包括第二晶体管、第三晶体管和第四晶体管；所述第二晶体管的栅极与所述第一时钟信号端电连接，所述第二晶体管的第一极与所述第一电平信号接收端电连接，所述第二晶体管的第二极、所述第四晶体管的栅极以及所述第三晶体管的第二极耦合于第四节点；所述第三晶体管的栅极与所述第二节点电连接，所述第三晶体管的第一极与所述第二时钟信号端电连接；所述第四晶体管的第一极与所述第一电平信号接收端电连接，所述第四晶体管的第二极与所述第一节点电连接；所述第二晶体管、所述第三晶体管和所述第四晶体管均为有源层为氧化物半导体的晶体管；所述发光控制驱动电路电连接的时钟信号线复用为所述扫描驱动电路的时钟信号线，所述时钟信号线用于提供所述第一时钟信号和所述第二时钟信号；所述发光控制驱动电路包括第一阶段、第二阶段、第三阶段、第四阶段、第五阶段和第六阶段，在所述第一阶段、所述第二阶段和所述第三阶段，所述触发信号输入端的输入信号为高电平信号，在所述第四阶段、所述第五阶段和所述第六阶段，所述触发信号输入端的输入信号为低电平信号，在所述第一阶段、所述第三阶段和所述第五阶段，所述第一时钟信号端接收的第一时钟信号为高电平信号，所述第二时钟信号端接收的所述第二时钟信号为低电平信号，在所述第二阶段、所述第四阶段和所述第六阶段，所述第一时钟信号端接收的第一时钟信号为低电平信号，所述第二时钟信号端接收的所述第二时钟信号为高电平信号，以使所述第一节点处的电平信号在所述第二阶段、所述第三阶段和所述第四阶段为低电平信号，在所述第一阶段、所述第五阶段和所述第六阶段为高电平信号，以及，使所述第三节点处的电平信号在所述第一阶段、所述第二阶段、所述第三阶段和所述第四阶段为高电平信号，在所述第五阶段和所述第六阶段为低电平信号，以及，使所述驱动信号输出端在所述第二阶段、所述第三阶段和所述第四阶段输出高电平阶段，在所述第一阶段、所述第五阶段和所述第六阶段输出低电平信号。

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